[其他]使用动态可重构向量位片的单指令多数据单元阵列处理机无效
申请号: | 86108178 | 申请日: | 1986-12-03 |
公开(公告)号: | CN86108178A | 公开(公告)日: | 1987-08-05 |
发明(设计)人: | 史蒂文·格雷葛瑞·莫顿 | 申请(专利权)人: | 国际标准电气有限公司 |
主分类号: | G06F15/16 | 分类号: | G06F15/16 |
代理公司: | 上海专利事务所 | 代理人: | 刘庆玫 |
地址: | 美国纽约州*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 使用 动态 可重构 向量 指令 多数 单元 阵列 处理机 | ||
1、一种应用排列成X/Y矩阵的多个处理单元的单元阵列,所述单元的每个均与其它单元相联接以使数据能向左、右、水平或垂直方向传送,特征在于其改进之处包括:
一个能够传送给定数量的位的公用总线,第一个若干位表示第一总线段和第二个若干位表示第二总线段,所述总线与一行中所述处理单元的每一个相联接,
与所述每一单元相联系并用来使所述单元根据所选择的方式自所述总线的第一总线段或第二总线段接收和传送数据的逻辑装置。
2、根据权利要求1的单元阵列,其特征在于每个所述处理机为一单一的16位处理机。
3、根据权利要求1的单元阵列,其特征在于所述公用总线是具有32位宽的总线,以全位宽与每个所述处理机相联接。
4、根据权利要求1所述的单元阵列,其特征在于所述与每个所述单元相联系的逻辑装置包括一个与每个所述单元和所述公用总线相联接以存储有关所述选择方式的信息的分离的存储装置。
5、根据权利要求4的单元阵列,其特征在于进一步包括一个行译码器,其与所述阵列的各行相联系的并与每个所述各个单元的存储器相联接以使一行中的各个单元能够根据与所述公用总线的所述第二总线段或所述第一总线段的操作而被选择。
6、根据权利要求5的单元阵列,其特征在于进一步包括一个总线接口装置,该装置具有与所述公用总线联接的输出,并且具有多重输入端,所述每个输入端与分离的数据总线联接,每一个数据总线的位宽与所述公用总线相同,和选择所述输入总线中任何一个以使所选择的输入总线与一输出端相联接的装置。
7、根据权利要求4的单元阵列,其特征在于所述存储器均为动态随机存取存储器(DRAM)。
8、根据权利要求7的单元阵列,其特征在于所述动态随机存取存储器可容纳256千位的数据。
9、根据权利要求1的单元阵列,其特征在于所述公用总线进一步包括一预定数目的奇偶检验位。
10、根据权利要求9的单元阵列,其特征在于所述预定数目的奇偶检验位为2。
11、根据权利要求5的单元阵列,其特征在于进一步包括与所述公用总线联接的、可驱动所述译码器以使所述处理机根据其与表明一个特定长的数字字的公用总线段的操作而被选择的地址发生装置。
12、根据权利要求6的单元阵列,其特征在于所述总线接口装置包括用于使所述总线输出能够提供多个不同输出电平中任何一个的逻辑电平控制装置。
13、根据权利要求1的单元阵列,其特征在于进一步包括一个与每个所述处理机联接的指令总线和把所述指令总线联接到所述公用总线的装置。
14、根据权利要求13的单元阵列,其特征在于它包括一个具有与所述公用总线联接的输入和与所述指令总线联接的输出的接收器。
15、根据权利要求14所述的单元阵列,其特征在于其中所述指令接收器包括与电平转换器联接的使所述指令总线能与所述公用总线在不同的可选择的逻辑电平上相联接的双向收发机。
16、根据权利要求1的单元阵列,其特征在于进一步包括与所述公用总线联接的、用以检验所述给定数量的位数的奇偶的奇偶发生检验装置。
17、根据权利要求1的单元阵列,其特征在于进一步包括:
与所述公用总线联接的、使所述阵列能够响应存储在所述外部存储器中的数据的外部存储装置。
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