[发明专利]多处理机通信信道无效
申请号: | 86108432.2 | 申请日: | 1986-12-19 |
公开(公告)号: | CN1010262B | 公开(公告)日: | 1990-10-31 |
发明(设计)人: | 巴拉德·约翰·布莱温斯;威廉姆·加里·库尔帕;约瑟夫·理查德·马斯 | 申请(专利权)人: | 国际商用机器公司 |
主分类号: | G06F13/36 | 分类号: | G06F13/36 |
代理公司: | 中国国际贸易促进委员会专利代理部 | 代理人: | 栾本生 |
地址: | 美国纽约州*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 处理机 通信 信道 | ||
1、一种在第一和第二数据处理装置之间传送数据的系统,每个所述的数据处理装置包括:
一个处理器;
一个存贮器,包括一个随机存取部分和一个与之相连的顺序存取部分;
一个系统总线,与所述的处理器和所述存贮器的随机存取部分相连,使得所述处理器能够访问所述的随机存取部分;
一个用于在存贮器的所述随机存取部分与所述的顺序存取部分之间传送数据块的装置,所述的数据块包括许多数据组,每个数据组包括一个预定的位数,在所述随机存取部分与所述顺序存取部分之间并行传输所述的许多数据组;
其特征在于:
一个信道装置,用于把所述第一数据处理装置中的存贮器的所述顺序存取存取部分与所述第二数据处理装置中的存贮器的所述顺序存取部分连接起来;
一个控制装置,与每个处理装置中的存贮器的所述顺序存取部分相连,用于控制在所述第一和第二处理装置中的所述顺序存取部分之间的所述数据块的传输,使之在不使用所述处理器和系统总线的情况下,通过所述信道装置连续地传输这许多数据组。
2、根据权利要求1的系统,其进一步的特征在于所述控制装置中的时钟装置,用于与所述处理器的操作异步地定时在所述顺序存取部分之间所述数据块的传输。
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