[其他]一种新型三元码编码/译码设备无效

申请号：	87102230	申请日：	1987-03-26
公开（公告）号：	CN87102230B	公开（公告）日：	1988-11-02
发明（设计）人：	马瑞芳;陈长林	申请（专利权）人：	中国科学院计算技术研究所
主分类号：	G06F3/00	分类号：	G06F3/00
代理公司：	中国科学院专利事务所	代理人：	戎志敏
地址：	北京市***	国省代码：	北京;11
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摘要：
搜索关键词：	一种新型三元编码译码设备
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【权利要求书】：

1、一种新型的三元码编码设备含有移位寄存器和逻辑电路，其特征是将随机的二进制数据序列变换成O游程限在2，5之内的三元码序列，输入移位寄存器有八位存贮单元a₀-a₇，它串行接收数据序列，并把存贮的八位数据子序列并行输出，逻辑电路依据输入移位寄存器的输出编码产生三位的码字C₀C₁C₂，并把它们并行送到输出移位寄存器，由该寄存器将它们串行输出。

2、按权利要求1所述的三元码编码设备，其特征在于其中所说的逻辑电路的逻辑表达式为：

C₀＝a₀a₂+a₁a₂a₃

C₁＝a₂a₄+a₂a₅+a₀a₁a₂

C₂＝a₂a₄a₅+a₂a₃+a₀a₂a₃a₄a₅a₇

3、一种新型的三元码编码设备含有移位寄存器和编码组合逻辑，其特征是把随机的二进制数据序列变换成0游程限在2，5之内的三元码序列，第一移位寄存器有六位存贮单元a₀-a₅，它串行接收数据序列，并把所存贮的六位数据子序列并行输出，编码组合逻辑根据第一移位寄存器的输出产生三位码字C₀C₀′、C₁C₁′、C₂C₂′，同时还产生一个P信号，该信号同C₀C₁C₂一起送到第二移位寄存器，并经第二移位寄存器延迟二个码位后反馈到编码组合逻辑参加编码，反馈后的信号记为P′，由编码组合逻辑产生的C₀′C₁′C₂′将并行送到第三移位寄存器，第二、第三移位寄存器将接收到的编码结果串行移出得到码序列CC′。