[发明专利]检测位相差的装置无效
申请号: | 87107585.7 | 申请日: | 1987-09-24 |
公开(公告)号: | CN1010538B | 公开(公告)日: | 1990-11-21 |
发明(设计)人: | 中沢敬 | 申请(专利权)人: | 日本电气株式会社 |
主分类号: | H04L1/22 | 分类号: | H04L1/22;H04L7/02 |
代理公司: | 中国专利代理有限公司 | 代理人: | 李先春,吴秉芬 |
地址: | 日本*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 检测 相差 装置 | ||
本发明涉及一种检测两个相同数据序列之间位相(bit phase)差的装置。两数据序列中每一个都通过各自的传输通路进行传输。
所述这样装置在许多处理数字的电子设备中都是必不可少的。例如,在具有一个主通道和一个备用通道的数字微波通信系统中两个相同数据序列分别在主通道和备用通道中并行传输(为区分起见,下文称之为数据序列A和B),由于两个独立通道之间存在传输延时差,它们彼此间的位相并不总是重合的。此外,由于传输延时差随时间起伏变化,因此数据序列A和B之间的位相偏差也随时间起伏变化。当位相不重合时,应该用主通道和备用通道中的一个切换另一个,切换时会带来位错。为了消除这种位错,可按以下步骤进行:确定数据序列A和B彼此间位相是否匹配,如果它们不匹配,就迫使其相对位相移动,直到数据序列重合,然后再由一个通道去切换另一通道。此种功能可用上述位相差检测装置来定成。
已有的检测位相差的装置包括一个比较器,用于检测两个数据序列A和B之间的位相差,也就是检测数据序列A和B的位相是否重合;还包括一个响应比较器输出信号的判定电路,用以判定数据序列A和B的位相是否匹配。然而,已有装置没有解决下述问题,也就是,当数据序列A和B每一个都只载有少量数据时,即处于所谓“轻负荷”状态时,数据系列A和B中各自每个预定数量的位中的数据位的数量,例如一帧中数据位的数量就减少,致使判定电路错误动作,从而不能精确检测位相差。
因此,本发明的目的是提供这样一种位相差检测装置:它能检测两个通过各自的传输通路而传播的相同数据序列之间的位相差,而无论每个数据序列的每个预定数量的位中的数据位的数目是否减少,甚至减少到零也无妨。
本发明的另一目的是提供一种全面改进了的位相差检测装置。
结合附图,从以下详细的描述中,本发明上述和其它发明目的,特点和优点将变的更为明显。
按照本发明,提供了一种检测两个相同数据序列A和B之间的位相差的装置。两数据序列中的每一个都各自通过两个传输通路中的一个进行传输。该装置包括用于进行串行到并行转换的序列转换部件,将数据序列A和B分别转换成位序列A1-Am和B1-Bm(M为正整数),其数目等于数据序列A和B帧周期的预定公共度量值(common measure);还包括M个位相检测部件,用于分别检测位序列A1-Am和与其彼此标号相同的位序列B1-Bm之间的相位差。因此,根据所述M个位相检测部件的输出,可确定数据序列A和B之间的位差。
图1为用于检测位相差的已有装置的方框图;
图2为实施本发明的用于检测位相差的装置的方框图;
图3为一方框图,示出图2中串行到并行转换的(S/P)转换器的具体组成;
图4A为一方框图,示出图3中序列转换电路的具体构成;
图4B为表明4A序列转换电路的输入和输出之间相互关系的表格;
图5A和图5B为一组定时图表,示出由图2中S/P转换器完成的转换关系;
图6为一定时图表,示出图2中S/P转换器和比较器的工作方式;
图7为一方框图,示出图2中判定电路的具体组成;
图8为判定电路的另一种组成的方框图。
为了更好地理解本发明,可重点参考图1所示的已有位相差检测装置。如图所示,已有的该装置,总体用10表示,包括一个由“异或”(EX-OR)门构成的比较器12和一个判定电路14。当比较器12接收数据序列A和B并产生一个比较信号C时,由判定电路14接收信号C,并判定数据序列A和B彼此位相是否重合。当两个输入信号重合时,EX-OR12输出(逻辑)“0”;当它们不重合时输出(逻辑)“1”。从这个含义上讲,EX-OR12对两个数据序列是逐位进行比较,从而得出其判定结果的。只要数据序列A和B的位相彼此匹配,同时数据序列A和B不存在传输位错,则比较器12的输出C只是一串“0”。然而,由于存在传输位错,有时信号C会成为“1”。还有,当数据序列A和B的位相不重合时,信号C通常有成为“1”的实际可能性。由判定电路14计算出每次每个预定时间周期内的信号为“0”和为“1”的频率,从而判定数据序列A和数据序列B是否重合。判定结果以判定信号D输出。
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