[其他]串行接口型可编程序只读存储器写入装置无效
申请号: | 88102017 | 申请日: | 1988-04-09 |
公开(公告)号: | CN88102017A | 公开(公告)日: | 1988-10-26 |
发明(设计)人: | 中山森博;宇仁田浩行;中信二 | 申请(专利权)人: | 松下电器工业有限公司 |
主分类号: | G11C7/00 | 分类号: | G11C7/00 |
代理公司: | 上海专利事务所 | 代理人: | 王树俦 |
地址: | 日本大阪*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 串行 接口 型可编 程序 只读存储器 写入 装置 | ||
1、一种串行接口型可编程序只读存储器(PROM)的写入装置,由并行输出对写入串行接口型PROM内的控制数据的地址进行设定的地址数据信号和对于一个地址数据信号来说为多位的控制数据信号的写入装置;和把上述并行地输出的各数据信号变换成串行数据信号,并向把此串行变换装置的输出信号作为输入的串行接口型PROM输出的串行变换装置组成,并且形成能根据上述写入装置的写入信号,把上述串行变换装置的输出数据向PROM写入。
2、根据权利要求1所述的装置,写入装置是由存储地址数据和控制数据的数据存储装置;和设定上述写入数据地址的数据地址设定装置;和控制由上述数据存储装置和上述数据地址设定装置设定的写入数据输出的写入脉冲控制装置;和总管上述数据存储装置,数据地址设定装置,写入脉冲控制装置的各个输出定时的基准时钟装置组成。
3、一种串行接口型可编程序只读存储器(PROM)的写入装置,由并行输出对写入串行接口型PROM内的控制数据的地址进行设定的地址数据信号和对于一个地址数据信号来说为多位的控制数据信号的写入装置;和把上述并行输出的各数据信号变换成串行数据信号而后输出的串行变换装置;和向把此串行变换装置的输出信号作为输入的串行接口型PROM;和输出使上述串行变换装置的输出数据向PROM写入指令的写入脉冲输出装置组成,而上述串行变换装置由把来自上述写入装置的地址数据信号变换成串行地址数据信号的串行地址变换装置;和把来自上述写入装置的控制数据信号(地址数据,控制数据)进行串行发送的发送装置构成。
4、根据权利要求3所述的装置,写入装置是由存储地址数据,控制数据的数据存储装置;和对上述写入数据的地址进行设定的数据地址设定装置;和对于用上述数据存储装置和上述数据地设定装置设定的写入数据的输出进行控制的写入脉冲控制装置;总管上述数据存储装置,数据地址设定装置,和写入脉冲控制装置的各输出定时的基准时钟装置构成。
5、根据权利要求3所述的装置,串行接口型PROM是由对来自发送装置的数据信号(串行数据信号)是地址数据信号还是控制数据信号进行选择的选择装置;和把用此选择装置选择的地址数据信号,控制数据信号分别变换成独立的地址数据输入信号和控制数据输入信号的并行地址变换装置,并行控制变换装置;写入和保持上述并行地址变换装置的地址数据和上述并行控制变换装置的控制数据的数据保持装置;用来自写入脉冲输出装置的信号,对把上述并行控制变换装置的数据向上述数据保持装置写入进行指示的写入装置构成。
6、根据权利要求4所述的装置,使串行接口型PROM由对来自发送装置的数据信号(串行数据信号)是地址数据信号还是控制数据信号进行选择的选择装置;把用此选择装置选择的地址数据信号,控制数据信号分别变换成独立的地址数据输入信号和控制数据输入信号的并行地址变换装置、并行控制变换装置;写入和保持上述并行地址变换装置的地址数据和上述并行控制变换装置的控制数据的数据保持装置;用来自写入脉冲输出装置的信号对把上述并行控制变换装置的数据向上述数据保持装置写入进行指示的写入装置构成。
7、一种串行接口型PROM写入装置,由并行输出写入串行接口型PROM内的地址数据信号和对一个地址数据信号来说为多位控制数据信号的写入装置;把上述并行输出的地址数据信号变换成串行数据信号,而后输出的串行地址变换装置;同样地把并行输出的控制数据信号变换成串行数据信号而后输出,还把串行控制数据信号变换成并行控制数据信号的串/并行控制变换装置;把来自上述串行变换装置,串/并行控制变换装置的信号(地址数据,控制数据)进行串行发送的发送装置;把此发送装置的输出信号作为输入的串行接口型PROM,输出使上述串行变换装置的输出数据向PROM写入指令的写入脉冲输出装置;将写入上述PROM内的控制数据在每次写入时读出,并向上述串/并行控制装置输出的读出装置;把从上述读出装置输出的串/并行控制装置的控制数据和从写入装置输出的控制数据进行校验的校验装置组成。
8、根据权利要求7所述的装置,使写入装置由存储地址数据和控制数据的数据存储装置;对上述写入数据的地址进行设定的数据地址设定装置;对由上述数据存储装置和上述数据地址设定装置设定的写入数据的输出进行控制的写入脉冲控制装置;总管上述数据存储装置、数据地址设定装置、写入脉冲控制装置的各个输出定时而基准时钟装置组成。
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