[发明专利]教学信息实时反馈及处理系统无效

专利信息
申请号: 88104582.9 申请日: 1988-07-21
公开(公告)号: CN1022868C 公开(公告)日: 1993-11-24
发明(设计)人: 顾力兵;徐章英 申请(专利权)人: 顾力兵;徐章英
主分类号: G09B7/02 分类号: G09B7/02
代理公司: 江西省专利事务所 代理人: 喻尚威
地址: 江西省南*** 国省代码: 江西;36
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摘要:
搜索关键词: 教学 信息 实时 反馈 处理 系统
【说明书】:

发明涉及以应答方式工作的电操作之教具,属于计算机辅助教学器具,尤其涉及一种教学信息实时反馈及处理系统。

目前以通用微型计算机系统和专用接口及反应器群相结合配置形式的教学信息实时处理系统。为单选反应方式,只能同步测试,数据处理速度较慢,而且采用多路开关方案,以于64个座位的课堂,主机接口引出线有64×9=576根导线,敷设和检修都比较困难。

本发明的目的在于克服上述系统之不足,从广大中小学实际情况出发,立足于中低档微机,提出一种新设计的教学信息实时反馈及处理系统。

本发明由微型计算机主机系统1、专用接口2(含接口总线IOBUS)、课堂地址总线AB、课堂数据总线DB和包括若干个学生终端(反应器)3的学生终端群ST构成。在主机系统1专用软件控制下通过专用接口2顺序地向课堂地址总线AB送出各个学生终端3的地址,被访问的学生终端3便将数据送入课堂数据总线DB,通过专用接口2采入主机系统1内存,并作各种处理。

主要系统1为通用微型计算机,包括系统软件及专用应用软件。本发明对其无特殊要求,可简可繁,配置8位16kRAM内存,CRT显示器及盒带放音机的简易系统也可以满足要求。

专用接口2、课堂地址总线AB、课堂数据总线DB及学生终端3都是为实现本发明的目的而专门设计的。

专用接口2是课堂总线AB、DB与主机接口总线IOBUS之间的缓冲器,由逻辑门4、数据三态门5和地址锁存器6组成。用于向课堂地址总线AB提供地址,并将数据采入主机1数据总线DATA,它还提供复位信号RES。其中逻辑门4的输入端与槽口设备选择线DS和读写线R/相联接,通过插件板插入主机相应槽孔,逻辑门4的一个输出端输出片选信号CS至数据三态门5,另一个输出端输出选通信号STROB至地址锁存器6,地址锁存器6的输入端接主机接口总线IOBUS数据总线DATA,而输出接课堂数据总线AB,数据三态门5的输入端接课堂地址总线DB,而输出端接主机接口总线IOBUS的数据总线DATA。当主机系统1通过接口总线IOBUS向地址锁存器6提供学生终端3的地址,并通过逻辑门4发出选通信号STROB,便将地址锁存于地址锁存器6的课堂地址总线AB。当主机系统1向专用接口2读入数据时,通过逻辑门4向数据三态门5发出片选信号CS,使课堂数据总线DB的数据通过数据三态门5采入主机1内存。专用接口2还为学生终端3提供电源。

课堂总线AB、DB通过接插件连接各个学生终端3。对于标准64座位而言,包括电源线在内可以少至13或14根线。其中课堂数据总线DB按同步测试单选方式使用3根导线,按自由选题异步测试多选方式使用5根导线,控制及电源总线使用4或3根导线,课堂地址总线按总线寻址方案时使用6根导线。

学生终端3是放置在每个学生课桌上的应答器。它由编码器7,单脉冲产生电路8、三态锁存器9、逻辑控制电路10和地址译码器11组成。其中逻辑控制电路10的设计是本发明的重要特征之一,它由脉冲整形电路12、状态寄存器13、两个与门电路14、15和脉冲分配电路16组成。脉冲整形电路12的输入端联接送数按键ON,其输出送至状态寄存器13,与门电路15的两个输入端分别与状态寄存器13输出端及学生终端3的地址译码器11的片选信号CS端相联接,并向学生终端3的三态锁存器9提供开放信号CE,脉冲分配电路16的输入端联接修改按键Cr,其输出分别接状态寄存器13和编码器7,与门电路14输入端分别与学生终端3的地址译码器11的片选信号CS端和课堂总线的复位线RES相联接,其输出端与状态寄存器13的复位端相联接,从而完成以下功能:

接受并贮存按键送来的送数指令(按下送数按键ON);

接受地址译码器11输出信号,当已经送数,便送出开放信号CE至三态锁存器9;

当复位信号RES有效,且地址被选中时,便消除送数指令;

接受修改指令(按下修改按键Cr),完成修改操作。

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