[发明专利]时间同步系统无效
申请号: | 93104567.3 | 申请日: | 1993-03-31 |
公开(公告)号: | CN1082285A | 公开(公告)日: | 1994-02-16 |
发明(设计)人: | M·L·韦沙曼;S·W·格列斯纳;R·E·本茨;J·R·考劳利-迪尔克斯 | 申请(专利权)人: | 格伦内勒电子有限公司 |
主分类号: | H04L7/04 | 分类号: | H04L7/04;H04B7/26 |
代理公司: | 中国专利代理(香港)有限公司 | 代理人: | 程天正,马铁良 |
地址: | 美国北卡*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 时间 同步 系统 | ||
1、一种可被发射基准时间信号的基准时钟所保持的时间同步的时钟,所述地钟包括:
a.一个连续步进的计数器,用于维持响应计时信号的时钟时间信号;
b.一个时间计数控制器,具有一个与所述计数器相连接用于建立时钟初始状态的初始化电路,一个与所述计数器相连接用于对其产生计时信号的计数器前进电路,及与一个所述初始化电路及所述计数器步进电路相连接用于接收时间差系数的时钟同步电路,由此,当所述时间差系数被其接收到时,所述时钟同步电路选择性地控制所述初始化电路建立一个新时钟初始状态及控制所述计数器步进电路以改变所述计时信号;及
c.一个差值计算电路,包括接收基准时间信号的第一接收电路及接收所述时钟时间信号的第二接收电路,以及一个用以计算基准时间信号及所述时钟时间信号之间的差作为所述时间差系数的,及用于将所述时间差系数发送到所述时钟同步电路的一个差值处理电路。
2、根据权利要求1的时钟,其中所述差值计算电路的第一接收电路与所述时钟同步电路相连接,用于对其提供基准时间信号;所述差值计算电路的第二接收电路包括在所述计数器及所述时钟同步电路之间的链路,通过它所述时钟时间信号提供到所述时钟同步电路;及其中所述时钟同步电路计算所述基准时间信号及所述时钟时间信号之间的所述时间差。
3、根据权利要求2的时钟,其中所述时钟同步电路是一个微处理机。
4、根据权利要求2的时钟,其中所述差值计算电路的第一接收电路是一个基准时间接收器它设计成接收基准时间信号并与所述时钟同步电路相连接用以对其传送基准时间。
5、根据权利要求4的时钟,其中基准时钟是一个卫星,及其中所述基准时间接收机适用于从该卫星接收基准时间信号。
6、根据权利要求4的时钟,其中:所述差值计算电路的第二接收电路包括连接在所述计数器及所述时钟同步电路之间的一个寄存器,其中所述寄存器在接收到定时脉冲信号时锁存所述时钟时间信号,及所述时钟同步电路由所述锁存时钟时间信号计算所述时间差系数;及
其中所述基准时间接收机与所述寄存器相连接,用于对其提供定时脉冲信号,以及其中所述定时脉冲信号是当所述第一基准时间接收机接收到基准时间信号时产生出的。
7、根据权利要求4的时钟,其中所述时钟同步电路是一个微处理机。
8、根据权利要求2的时钟,其中所述计数器步进电路包括一个发生可变频率输出信号的一个压控振荡器,用于产生一个可变频率的计时信号,及其中所述时钟同步电路将控制电压提供给所述压控振荡器,用于建立所述计时信号。
9、根据权利要求7的时钟,其中所述压控振荡器输出信号的频率大于所述计时信号的频率,及其中所述计数器步进电路包括一个分频器,用于接收压控振荡器输出信号及由其产生所述时钟时间信号。
10、根据权利要求9的时钟,其中所述差值计算电路的第一接收基准时间信号并与所述时钟同步电路相连接用于对其传送基准时间信号。
11、根据权利要求10的时钟,其中所述差值计算电路的第二接收电路还包括一个连接在所述计数器及所述时钟同步电路之间的寄存器,其中所述寄存器及所述寄存器在接收到定时脉冲信号时锁存所述时钟时间信号,及所述时钟同步电路从所述锁存的时钟时间信号计算所述时间差系数;以及在其中,所述基准时间信号接收机与所述寄存器相连接,用于对其提供所述定时脉冲信号,及其中所述定时脉冲信号是在所述基准时间接收机接收到基准时间信号时产生的。
12、根据权利要求1的时钟,其中所述差值计算电路是远离所述时间计数控制器的维护操作点的一部分,及其中所述维护操作点包括:用以周期性从基准时钟接收基准时间信号的第一接收机;与所述第一接收机相连接用于维持基准时间信号的一个维护操作时钟;第二个接收机用于接收所述时钟时间信号;及,一个时间差值计算电路,它与所述维护操作点时钟相连接用于接收基准时间信号,及与所述第二接收电路相连接用于接收所述时钟时间信号,用于计算基准时间信号及所述时钟时间信号,用于计算基准时间信号及所述时钟时间之间的时间差系数,并将该表示所述时间差系数的差值信号传送给所述时钟同步电路;及其中时钟同步电路包括一个接收机,用于从所述维护操作点接收所述差值信号。
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