[发明专利]专用小交换机中的值班操纵台的接口方法和设备无效
申请号: | 94119028.5 | 申请日: | 1994-12-01 |
公开(公告)号: | CN1072873C | 公开(公告)日: | 2001-10-10 |
发明(设计)人: | 蔡镕宇;朴真暎 | 申请(专利权)人: | 现代电子产业株式会社 |
主分类号: | H04L12/02 | 分类号: | H04L12/02 |
代理公司: | 中国国际贸易促进委员会专利商标事务所 | 代理人: | 付建军 |
地址: | 韩国*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 专用 交换机 中的 值班 操纵台 接口 方法 设备 | ||
本发明涉及用于综合业务数字网络(ISDN)中的中等容量的专用小交换机(PBX)中的值班操纵台的接口方法和设备,并具体涉及用于将值班操纵台的个人计算机与专用小交换机(PBX)的系统相接口的方法和设备,用于在值班操纵台与PBX系统之间处理和中继数据。
一般地,IEEE-488标准总线被称为通用接口总线(GPIB)。该IEEE-488标准总线被用作精确测量装置、小型计算机或微型计算机中的标准接口。
该IEEE-488标准总线具有双向并行传送的结构。因此,该总线的传送速度比串行传送结构的RS-232C接口快得多。
为了维护和修理综合业务数字网络(ISDN),这种维护和修理的大量数据必须在短时间内得到迅速的处理,虽然这种维护和修理数据的处理速度根据编程器产生的信息的结构可以有所不同。
当采用具有串行传送结构的接口总线时,需要很长的时间传送和处理数据,从而降低了整个专用小交换机(PBX)系统的效率。另外,具有串行传送结构的接口总线需要值班操纵台来监视和控制各种数据,诸如要求所需的信息和提取和保持各种与专用小交换机(PBX)的操作者有关的各种数据。
本发明的一个目的是解决现有技术遇到的这些问题。
本发明的另一个目的,是提供利用IEEE-4888总线将值班操纵台计算机与专用小交换机相接口的方法和设备,从而即使当传送和处理用于监视和控制专用小交换机的数据时,也不会降低专用小交换机的性能,从而达到实时处理。
本发明的进一步的目的,是利用IEEE-488标准接口来连接用在综合业务数字网络的交换机的值班操纵台。
本发明的再一个目的,是提供一种专用小交换机,它检查与交换、帐单信息、时间相关信息、自身诊断信息等等有关的状态,从这些信息提取数据并在出现错误时采取适当的措施。
根据本发明的一种接口方法包括以下步骤:
a)检查是否从数据交换板接收到了数据;
b)当已经从数据交换板接收到数据时,确定接收数据的种类;
c)当接收数据是中继数据时,将接收的中继数据传送到一个值班操纵台,并返回到步骤(a);
d)当在步骤(b)接收的数据不是中继数据而是可自行处理数据时,将该可自行处理数据存储在一个存储器中;
e)当在步骤(a)未从数据交换板接收到数据时,检查是否从一个值班操纵台接收到了数据;
f)当已经在步骤(a)从该值班操纵台接收到数据时,确定从值班操纵台接收的数据的种类;
g)当从值班操纵台接收的数据是中继数据时,将该中继数据传送到数据交换板;以及
h)当从值班操纵台接收的数据不是中继数据而是可自行处理数据,向值班操纵台传送对该可自行处理数据的一个响应。
根据本发明的用于将一个值班操纵台与一个专用小交换机(PBX)相接口的设备,包括一个主板和一个副板以及通过一个值班操纵台接口而与该主板相连的值班操纵台,该主板包括:
通过一个基准速率接口与一组用户相连接的第一用户板,
第一基群速度接口板,它通过一个基速率接口而与一个综合业务数字网络(ISDN)的交换机相连,
一个数据分配板,用于将来自第一用户板和第一基群速度接口板的数据集中在一个架上,以分配和中继集中的数据,且该副板包括:
一个第二用户板,它通过另一基准速率接口(BRI)而与一组用户相连,用于将用户的数据加到主板的数据交换板上,
一个第二基群速度接口板,它通过另一基速率接口(PRI)而与专用小交换机(PBX)的交换机相连,
一个第二数据分配板,用于将来自第二用户板和第二基群速度接口板的数据集中在另一个架上,
该主板进一步包括:
一个数据交换板,用于从第一和第二数据分配板、第一和第二用户板、主板和副板的第一和第二基群速度接口板切换并有选择地产生数据,
一个主控制板,用于处理并中继从第一和第二用户板、第一和第二数据分配板以及第一和第二基群速度接口板的数据,并维护/修理从值班操纵台接收的数据。
从以下结合附图所进行的详细描述,本发明的上述和其他目的、特征和优点,将变得更为明显。在附图中:
图1是采用根据本发明的值班操纵台接口的专用小交换机(PBX)的框图;
图2是图1的根据本发明的专用小交换机(PBX)的主控制板的框图;
图3是图2的根据本发明的主控制板所进行的处理的流程图;
图4显示了图2的根据本发明的主控制板的双端口RAM的存储器分配;
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