[实用新型]单相磁卡电度表无效

专利信息
申请号: 94231949.4 申请日: 1994-12-29
公开(公告)号: CN2229667Y 公开(公告)日: 1996-06-19
发明(设计)人: 朱荣昌;叶征宇;盛家宁 申请(专利权)人: 盛家宁;朱荣昌
主分类号: G01R11/56 分类号: G01R11/56;G01R22/00
代理公司: 小松专利事务所 代理人: 张耀光
地址: 100086 北京*** 国省代码: 北京;11
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摘要:
搜索关键词: 单相 磁卡 电度表
【权利要求书】:

1、一种单相磁卡电度表,包括单相电度表U9、磁卡识别电路U12、抹卡电路U13、中央处理器CPU、存贮器U6、显示驱动器U4、LED数码显示管U7、稳压电路U8和复位电路U3,其特征在于还设有磁卡处理芯片U2、存贮显示控制驱动器U5和继电器执行电路U10,继电器执行电路由继电器J1光耦合器U1A、U1B和放大器F1组成,F1是三极管BG1射极跟随器,磁头线圈输出信号经磁卡识别电路U12送到磁卡处理芯片U2的输入端V01、V02,磁卡处理芯片U2的输出端RCL、RDL与中央处理器CPU的入口INT0、P1.7相连接;单相电度表U9的输出端PULSE与CPU的INT1端口连接;CPU的输出口P0.0-P0.7与显示驱动器U4的入口D0-D7及存贮显示控制驱动器U5的入口D0-D7相连接;显示驱动器U4的输出端Q0-Q7与LED数码显示管U7的1-8端相连接;存贮显示器控制驱动器U5的Q0-Q3端分别与LED数码显示管U7的控制端LED1-LED4相连接,存贮显示控制驱动器U5的输出端Q5-Q7分别与存贮器U6的Cs、CLK及D1端口连接;存贮器的输出端D0与CPU的串行输入口P1.0连接;CPU的控制端WR、P2.6经或门H1与显示驱动器U4的控制端CLK相连接;CPU的控制端WR、P2.7经或门H2与存贮显示控制驱动器U5的控制端CLK相连接;CPU的P1.1、P1.2端口经与门Y1接光耦合器U1A输入端,其输出端接放大器F1三极管BG1的基极;继电器J1一端接在三极管B1发射极,继电器J1的另一端接地;继电器J1常闭接点的一端K1-1接电源火线,常闭接点的另一端J1-2接单相电度表U9输入端及光耦合器U1B输入端,光耦合器U1B输出端RLY1接CPU的RXD端口;CPU的P1.5端口接抹卡电路U13输入端ERS,其输出端ERSE接磁头线圈。

2、根据权利要求1所述的单相磁卡电度表,其特征在于CPU的P1.6端口接与门Y2,与门Y2输出端接报警器U11

3、根据权利要求1所述的单相磁卡电度表,其特征在于板警器U11由三极管BG2和陶瓷发声片LB组成,它是一射极跟随器,陶瓷发声片LB串接在发射极与电源负极之间。

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