[发明专利]用于装满比特位的数据的可变长译码装置无效
申请号: | 95107135.1 | 申请日: | 1995-05-31 |
公开(公告)号: | CN1073307C | 公开(公告)日: | 2001-10-17 |
发明(设计)人: | 文宪熙 | 申请(专利权)人: | 三星电子株式会社 |
主分类号: | H03M7/40 | 分类号: | H03M7/40 |
代理公司: | 中国专利代理(香港)有限公司 | 代理人: | 叶恺东,张志醒 |
地址: | 韩国京畿*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 用于 装满 比特 数据 变长 译码 装置 | ||
1.一种可变长译码装置,用于对以位流形式传送的数据进行变长译码,所述数据填充了比特,且被变长偏码为一预定的比特数,所述数据被分隔为多个MMB(宏块群),这些宏块群组若干个帧,各个帧的开始部分包括一个预设的帧起始符,各个MMB的开始部分包括一个MMB起始符,其特征在于,所述可变长译码装置包括:
一个先进先出存储器,用于存储被传送的数据,并顺次地输出以首先存储的比特作为开始的所述数据的一个预定比特数,所述数据的存储和顺次输出发生在每次当一个读出信号输入到所述存储器的时候;
译码单元,用于根据控制信号对输入数据作变长译码,在每次用于变长译码中的数据的比特数等于预定的比特数时即产生数据请求信号,所述译码单元在收不到在多个数据块间隔之一中的数据块结束信号时产生块结束差错信号;
译码接口单元,用于按照开始信号和所述译码单元发出的数据请求信号产生所述读出信号,根据读出信号接收并存储来自所述先进先出存储器的所述预定的数据比特数,当从输入的数据比特检测到所述帧起始符和所述MMB起始符中之一时即中断读出信号的产生,而在接收到初始化信号时则将所输入的数据的所述预定的比特数输出给所述译码单元;和
定时控制单元,用于产生每一帧间隔的所述开始信号和每一MMB间隔的所述初始化信号,并将所述开始信号和所述初始化信号供给所述译码接口单元,在接收到来自所述译码单元的块结束信号时即产生新的开始信号,并将之提供给所述译码单元,所述定时控制单元产生一信号,并将之提供给所述译码单元用以控制所述可变长译码装置的操作。
2.如权利要求1中所述的可变长译码装置,其特征在于,所述译码接口单元包括有:
数据锁存单元,其数据输入端与所述先进先出存储器的数据输出端相连接,所述数据锁存单元的数据输出端连接到所述译码单元,所述数据锁存单元在每次所述读出信号输入到所述先进先出存储器时,将从所述先进先出存储器所输出的数据每次以所述预定的比特数加以锁存;
检测器,接收来自所述数据锁存单元锁存的数据和所述先进先出存储器的输出数据,检测帧起始符或MMB起始符,并输出其值表示检测结果的第1二进制信号,在所述定时控制单元发出的开始信号或初始化信号输入到所述译码单元时,所述检测器将被锁存的第1二进制信号清除;
控制信号产生单元,用于产生所述读出信号,该读出信号的值是用以起动从所述先进先出存储器读出数据的第1二进制值,或是用以停止从所述先进先出存储器读出数据的第2二进制值;所述控制信号单元还产生一个选择信号,所述选信号的值是用以重新锁存供自所述先进先出存储器的数据的第1二进制值,或是用以保持已锁存的从所述先进先出存储器所供给的数据第二2进制值。
3.如权利要求2中所述的可变长译码装置,其特征在于,所述数据锁存单元包括有:
第一和第二锁存器,用于将按读出信号将从所先进先出存储器输出的所述数据每次以一定的比特依次锁存,并将被锁存的数据输出至所述译码单元;
第一多路器,用于接收所述先进先出存储器的输出数据和所述第一锁存器的输出数据,并根据所述选择信号的二进制值将所述接收数据输出给所述第一锁存器;
第二多路器,用于接收所述第一锁存器的输出数据和所述第二锁存器的输出数据,根据所述选择信号的二进制值将所述接收数据输出给所述第二锁存器。
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