[发明专利]多协议数据总线系统无效
申请号: | 95108421.6 | 申请日: | 1995-07-14 |
公开(公告)号: | CN1083590C | 公开(公告)日: | 2002-04-24 |
发明(设计)人: | G·A·埃得;M·D·兰迪斯 | 申请(专利权)人: | 汤姆森消费电子有限公司 |
主分类号: | G06F13/38 | 分类号: | G06F13/38 |
代理公司: | 中国专利代理(香港)有限公司 | 代理人: | 董巍,王忠忠 |
地址: | 美国印*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 协议 数据 总线 系统 | ||
1.一系统,包括:
数据总线,所述数据总线包括第一(SCL)、第二(CLOCK)和第三(DATA)信号通路,该系统特征在于:
控制器(100)连接至所述第一,第二和第三信号通路,所述控制器在所述系统的第一操作模式期间根据第一数据总线协议(IIC)产生第一时钟信号和第一数据信号,和在第二操作模式期间根据第二数据总线协议(IM)产生第二时钟信号和第二数据信号;
所述控制器在所述第一操作模式期间分别在所述第一(SCL)和第三(DATA)信号通路上提供所述第一时钟信号和所述第一数据信号,和在所述第二操作模式期间分别在所述第二和第三(DATA)信号通路上提供所述笫二时钟信号和所述第二数据信号。
2.权利要求1所述的系统,其特征在于还包括:在所述第二操作模式期间在所述第一(SCL)信号通路上保持预定信号电平的电阻(R4)。
3.权利要求2所述的系统,其特征在于:
所述第一和第二时钟信号以及所述第一和第二数据信号是至少呈现两种二进制状态中的一种状态的二进制信号;
在所述第三(DATA)信号通路上的所述第一数据信号在所述两种二进制状态之间的转换期间,所述第一(SCL)信号通路上的所述第一时钟信号呈现所述两种二进制状态中的第一种状态,以便表示在所述第一操作模式期间经由所述数据总线的通信状态;
所述电阻(R4)在所述第二操作模式期间在所述第一信号通路上建立的所述预定信号电平是所述两种二进制状态中的第二种状态的表示。
4.权利要求3所述的系统,其特征在于:所述控制器(100)包括具有与所述第三(DATA)信号通路连接的输出端的微处理器(520),在所述第一和第二操作模式期间,所述微处理器(520)在软件控制下在其所述输出端产生所述第一和第二数据信号。
5.权利要求4所述的系统,其特征在于:
所述数据总线是串行数据总线;
所述第一数据总线协议包括IIC串行数据总线协议;
所述第二数据总线协议包括IM串行数据总线协议。
6.权利要求5所述的系统,其特征在于:
所述数据总线还包括第四信号通路(IDENT);和
所述控制器根据所述第二数据总线协议产生启动信号以及在所述第二操作模式期间在所述第四信号通路上提供所述启动信号。
7.权利要求1所述的系统,其特征在于还包括:
开关装置(530),响应控制信号(CTRL)以便在所述第一操作模式期间将所述第一数据信号接至所述第三(DATA)信号通路以及在所述第二操作模式期间将所述第二数据信号接至所述第三(DATA)信号通路;
所述控制器(100)产生表示所述系统是处于所述第一还是所述第二操作模式的所述控制信号(CTRL)。
8.权利要求7所述的系统,其特征在于还包括:在所述第二操作模式期间在所述第一信号通路上建立预定信号电平的偏置装置(R4)。
9.权利要求7所述的系统,其特征在于所述控制器还包括:
微处理器(520),在软件控制下,在所述第一操作模式期间在其输出端产生所述第一数据信号;和
移位寄存器(512),在所述第二操作模式期间在其输出端产生所述第二数据信号;
所述开关装置(530)响应所述控制信号(CTRL)以便在所述第一操作模式期间将所述微处理器的所述输出接至所述第三(DATA)信号通路以及在所述第二操作模式期间将所述移位寄存器(512)的所述输出接至所述第三(DATA)信号通路。
10.权利要求9所述的系统,其特征在于:
所述数据总线是串行数据总线;
所述第一数据总线协议包括IIC串行数据总线协议;
所述第二数据总线协议包括IM串行数据总线协议。
11.权利要求10所述的系统,其特征在于:
所述数据总线还包括第四(IDENT)信号通路;
所述控制器(100)根据所述第二数据总线协议产生启动信号以及在所述第二操作模式期间在所述第四(IDENT)信号通路上提供所述启动信号。
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