[发明专利]DRAM内装数据处理器件无效
申请号: | 96180263.4 | 申请日: | 1996-03-21 |
公开(公告)号: | CN1217084A | 公开(公告)日: | 1999-05-19 |
发明(设计)人: | 山岸一繁;佐藤润;宫本崇 | 申请(专利权)人: | 株式会社日立制作所 |
主分类号: | G11C11/34 | 分类号: | G11C11/34;G06F12/02;G06F1/20 |
代理公司: | 中国国际贸易促进委员会专利商标事务所 | 代理人: | 王永刚 |
地址: | 日本*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | dram 数据处理 器件 | ||
1.一种半导体集成器件,特征在于
在一块半导体衬底上具有集成了逻辑电路的图像用处理器,存储命令以及源数据的第1动态型RAM,存储描绘信息的第2动态型RAM,
上述第1动态型RAM和上述第2动态型RAM配置在上述图像用处理器的两端。
2.一种半导体集成器件,特征在于
在一块半导体衬底上具有集成了逻辑电路的图像用处理器,存储命令以及源数据的第1动态型RAM,存储描绘信息的第2动态型RAM,
上述图像用处理器配置在上述第1动态型RAM和第2动态型RAM之间。
3.一种半导体集成器件,特征在于
在一块半导体衬底上具有集成了逻辑电路的图像用处理器,存储命令以及源数据的第1动态型RAM,存储描绘信息的第2动态型RAM,
上述第1动态型RAM和上述第2动态型RAM分别配置在上述半导体衬底的短边一侧。
4.如权利要求1记述的半导体集成器件,特征在于
构成上述第1以及第2动态型RAM的上述多个动态型RAM分别由多个存储体构成,在相等地址被激活的数据线的比特数在上述第1动态型RAM和上述第2动态型RAM中分别相等。
5.如权利要求1记述的半导体集成器件,特征在于
上述第2动态型RAM由2个动态型RAM构成,通过上述图像用处理器,上述2个动态型RAM中1个用作描绘用动态型RAM,另一个用作显示用动态型RAM,描绘用和显示用交替转换。
6.如权利要求1记述的半导体集成器件,特征在于
经过上述图像用处理器从上述第1动态型RAM向上述第2动态型RAM传送用于描绘的图像信息,经过该图像用处理器把在上述第2动态型RAM中描绘的图像信息输出到外部。
7.如权利要求1记述的半导体集成器件,特征在于
上述图像用处理器由以下部分构成
从上述第1动态型RAM取出指令,取出结束后输出侧边运算开始信号的描绘指令取出单元,
在预定的每条线分割变换的原图像时,进行变换后的始点和终点坐标的运算的侧边运算单元,
充填上述线的始点和终点之间作成直线,进行添加地址运算的直线运算单元,
从上述第1动态型RAM取出像素数据,开始对上述第2动态型RAM存储器的访问,写入描绘地址以及像素数据的像素运算单元,
把上述第2动态型RAM的显示数据输出到外部的显示控制器。
8.如权利要求7记述的半导体集成器件,特征在于
上述描绘指令取出单元根据从外部的数据处理装置输入的描绘开始信号从上述第1动态型RAM取出命令,在上述取出结束后向上述侧边运算单元输出侧边运算开始信号,
上述侧边运算单元接受上述侧边运算开始信号开始进行侧边运算,该运算结束后向上述直线运算单元输出直线运算开始信号,同时在直线运算单元中进行其运算结果的设定以及开始下一个侧边运算,
上述直线运算单元接受上述直线运算开始信号开始进行直线运算,该运算结束后向上述像素运算单元输出存储器访问开始信号,同时在上述像素运算单元中设定其运算结果,
上述像素运算单元接受上述存储器访问开始信号,从上述第1动态型RAM取入像素数据,开始对上述第2动态型RAM的存储器访问,写入描绘地址以及像素数据,
上述显示控制单元把上述第2动态型RAM的显示数据输出到外部。
9.如权利要求7记述的半导体集成器件,特征在于
上述第2动态型RAM从上述像素运算单元写入描绘地址以及像素数据,经过上述显示控制单元把所描绘的图像信息输出到外部。
10.如权利要求1记述的半导体集成器件,特征在于
上述图像用处理器
根据从外部的数据处理装置输入的描绘指令从上述第1动态型RAM取出命令,
在取出结束后进行图像运算,
把该运算结果在上述第2动态型RAM中进行描绘,
把描绘数据输出到外部。
11.如权利要求2记述的半导体集成器件,特征在于
构成上述第1以及第2动态型RAM的上述多个动态型RAM分别由多个存储体构成,在相等地址被激活的数据线的比特数在上述第1动态型RAM和上述第2动态型RAM中分别相等。
12.如权利要求3记述的半导体集成器件,特征在于
构成上述第1以及第2动态型RAM的上述多个动态型RAM分别由多个存储体构成,在相等地址被激活的数据线的比特数在上述第1动态型RAM和上述第2动态型RAM中分别相等。
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