[发明专利]配置逻辑器件阵列的方法和系统无效
申请号: | 97199308.4 | 申请日: | 1997-10-15 |
公开(公告)号: | CN1241275A | 公开(公告)日: | 2000-01-12 |
发明(设计)人: | M·T·梅森;S·C·埃文斯;S·S·阿拉耐克 | 申请(专利权)人: | 爱特梅尔股份有限公司 |
主分类号: | G06F17/50 | 分类号: | G06F17/50 |
代理公司: | 上海专利商标事务所 | 代理人: | 李玲 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 配置 逻辑 器件 阵列 方法 系统 | ||
1.一种配置可编程逻辑单元阵列的方法,其特征在于:所述阵列包括多个可编程互连关系,每个所述逻辑单元在所述阵列中具有一个唯一单元位置,所述阵列具有一种相关的逻辑设计,所述方法包括:
访问一个设计数据库,该数据库代表逻辑单元定义和对应于所述逻辑设计的逻辑单元互连关系的一种配置;
把所述设计数据库的一部分提供给用户;
输入用户指定的变化,对所述设计数据库的用户所选部分进行重新定义;
产生一部分配置位流,仅描述与所述设计数据库的所述重新定义部分相关的所述逻辑单元和所述的互连关系;以及
将所述部分配置位流下载到所述逻辑单元阵列中,由此仅配置所述逻辑单元阵列中对应于所述用户指定变化的这些部分。
2.如权利要求1所述的方法,其特征在于:所述的产生步骤包括仅基于所述设计数据库的所述已重新定义部分来定义所述部分配置位流。
3.如权利要求1所述的方法,其特征在于:所述的用户指定变化包括新的逻辑单元定义或新的互连关系,所述的产生步骤包括仅基于所述新逻辑单元定义或所述新互连关系来定义所述部分配置位流。
4.如权利要求1所述的方法,其特征在于:所述的提供步骤包括识别被配置为逻辑门的特定逻辑单元以及对于每一个所述特定逻辑单元显示其单元位置和显示其相应逻辑门的图形图象或文本表示。
5.如权利要求4所述的方法,其特征在于:所述的输入用户指定变化的步骤包括识别有待重新配置的逻辑单元、显示备用逻辑门的表以及从所述表中选择一个备用逻辑门,对所述被识别逻辑单元进行重新配置。
6.如权利要求5所述的方法,其特征在于:所述的显示备用逻辑门表的步骤包括显示所述备用逻辑门的图形表示。
7.如权利要求4所述的方法,其特征在于:所述的提供步骤进一步包括:
识别所述设计数据库中的固定值逻辑单元;
对于不与其它任何固定值逻辑单元邻接的固定值逻辑单元,显示所述固定值逻辑单元的单元位置和当前值;以及
对于一组相邻的固定值逻辑单元,将所述这组的单元位置显示为单元位置的范围以及将所述组中的逻辑单元的当前值显示为位流。
8.如权利要求1所述的方法,其特征在于:所述的提供步骤包括仅显示被限定输出常数逻辑“1”或常数逻辑“0”的这些逻辑单元。
9.如权利要求1所述的方法,其特征在于:所述的提供步骤包括:
识别所述设计数据库中的固定值逻辑单元;
对于不与其它任何固定值逻辑单元邻接的固定值逻辑单元,显示所述固定值逻辑单元的单元位置和当前值;以及
对于一组相邻的固定值逻辑单元,将所述这组的单元位置显示为单元位置的范围以及将所述组中的每个逻辑单元的当前值集中地显示为位流。
10.一种在FPGA中产生所述FPGA的配置位流的方法,所述FPGA包括可编程逻辑单元和I/O块以及设置在所述逻辑单元与所述I/O块之间的可编程互连关系,所述方法包括:输入一逻辑电路,所述逻辑电路包括多个逻辑门和所述逻辑门之间的连接;选择逻辑单元和互连关系来实现所述逻辑电路;形成一个包含所述所选逻辑单元和互连关系的放置和选路信息的设计数据库;根据所述放置和选路信息产生第一配置位流,所述第一配置位流包括所有的所述所选逻辑单元和互连关系的定义,由此而实现所述逻辑电路;把所述第一配置位流存储到数据存储器中,接着下载到所述FPGA中;以及将变化加入到所述逻辑电路设计中;所述方法的改进包括:
向用户显示所述设计数据库的部分和输入对所述设计数据库所选部分的修改;
产生第二配置位流,包括仅针对所述逻辑单元和所述互连关系中与所述设计数据库的所述所选部分的所述修改相关的这些的新定义。
11.如权利要求10所述的方法,其特征在于进一步包括把所述第一配置位流下载到所述FPGA中的步骤。
12.如权利要求11所述的方法,其特征在于:在对所述第一配置位流进行下载的所述步骤后进一步包括把第二位流下载到所述FPGA中的步骤。
13.如权利要求10所述的方法,其特征在于:所述的产生第二配置位流的步骤包括仅基于所述逻辑单元和互连关系的所述这些的位置和新定义而定义位流。
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