[发明专利]高清晰度电视视频解码器的子图象合成装置及其方法无效

专利信息
申请号: 98102821.7 申请日: 1998-07-08
公开(公告)号: CN1065391C 公开(公告)日: 2001-05-02
发明(设计)人: 孙军;梁昌钛;楚明;虞正华 申请(专利权)人: 国家科学技术委员会高技术研究发展中心
主分类号: H04N5/14 分类号: H04N5/14
代理公司: 北京邦大专利事务所 代理人: 魏殿绅
地址: 100862 *** 国省代码: 北京;11
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摘要:
搜索关键词: 清晰度 电视 视频 解码器 图象 合成 装置 及其 方法
【说明书】:

发明涉及视频解码技术,具体地涉及到用于高清晰度电视视频解码器的子图象合成装置及其方法。

当前,通用的数字高清晰度电视编码技术是MPEG-2技术。它由ISO/IEC13818文件描述。由于高清晰度电视视频编码器的计算量十分巨大,需要通过并行处理才能达到实时性要求。

鉴于MPEG-2 HDTV视频编码器的巨大计算量和计算速度。当前采用将HDTV画面分成若干子图象,对每个子图象用一个视频编码器进行编码,通过多个子编码器协同工作来实时地实现HDTV视频编码的体系结构。同样,在解码端再将码流分割成为多个子图象,分别对子图象进行解码。最后,为了显示高清晰度电视画面,就必须将这些低分辩率的子图象数字视频信号合成为高清晰度电视信号。

因此,本发明的目的是提供一种高清晰度电视视频解码器的子图象合成装置及其方法。

按照本发明的一种高清晰度电视视频解码器的子图象合成装置,其中所说的高清晰度电视视频解码器包括:码流分割单元(2),用于对HDTV码流进行分割;多个子解码器(3-1至3-n),以对所分割的各个子图象码流进行解码,其特征在于:

所说子图象合成装置包括其数量与上述多个子解码器(3-1至3-n)对应的多个FIFO(41-1,42-1,43-1,44-1,…,41-n,42-n,43-n,44-n),以及可编程逻辑器件(45);上述经解码的数据视频信号由所说子图象合成装置合成为一路高清晰度电视视频数据,再经D/A变换器(5)变换成模拟高清晰度电视视频信号,以送到显示单元进行显示。

按照上述的一种高清晰度电视视频解码器的子图象合成装置,所说由多个子图象解码器(3-1至3-n)解码的视频信号是符合CCIR601格式的SDTV视频数据;每路视频数据被分解成4部分:奇数列亮度信号Y1,偶数列亮度信号Y2,色差信号C’b和C’r,分别用1片FIFO来存储,它们分别是Y1 FIFO(42-1),Y2 FIFO(44-1),C’b FIFO(41-1),C’r FIFO(43-1);在合流的第一阶段,各子图象的Y1,Y2,C’b和C’r按视频显示的扫描顺序依次读出,这主要靠可编程逻辑器件控制FIFO的读使能来实现;第二阶段,再由延时小的可编程逻辑器件45将Y1,和Y2合二为一,顺序输出。

按照本发明的一种高清晰度电视视频解码器的子图象合成方法,其中所说的高清晰度电视视频解码器包括:码流分割单元(2),用于按扫描顺序对HDTV码流进行分割;多个子解码器(3-1至3-n),以对所分割的各个子图象码流进行解码,其特征在于:

所说子图象合成方法包括:

步骤1,将每路视频数据被分解成4部分:奇数列亮度信号Y1,偶数列亮度信号Y2,色差信号C’b和C’r;

步骤2,分别用1片FIFO来存储上述每路视频数据的所分解的4部分;

步骤3,按视频显示的扫描顺序依次读出上述FIFO所存储的内容;

步骤4,再由延时小的可编程逻辑器件将Y1和Y2合二为一,顺序输出。

下面将结合附图对本发明的最佳实施例进行描述。

图1为高清晰度电视视频解码系统的结构方框图;

图2为按照本发明的高清晰度电视视频解码器的子图象合成装置的方框图;

在图1中,进入视频解码器的是高清晰度电视数据码流,它符合MPEG-2标准。首先去复用器1对该HDTV码流进行去复用,去复用器1输出三路码流,即向视频解码器输出视频流,向音频解码端输出音频流,向辅助数据口输出辅助数据流。因为视频流是高清晰度级的,所以在进入视频解码器前先利用码流分割单元2对码流进行分割,以降低解码所需的计算量和速度,然后分别送入各个子解码器3-1至3-n,以对所分割的各个子图象码流进行解码,经解码的数据视频信号由码流合成单元4合成为一路高清晰度电视级视频数据,再经D/A变换器5变换成模拟高清晰度电视视频信号,以送到显示单元(未显示)进行显示。系统控制器6分别对去复用器1,码流分割单元2,各个子解码器3-1至3-n,码流合成单元4以及D/A变换器5进行控制。

本发明就是要提供一种可用于上述高清晰度电视视频解码器中的码流合成单元4。

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