[发明专利]无刷式直流马达的驱动方法及驱动电路有效
申请号: | 99121726.8 | 申请日: | 1999-10-10 |
公开(公告)号: | CN1292601A | 公开(公告)日: | 2001-04-25 |
发明(设计)人: | 许家彰;杨治世;林文泰 | 申请(专利权)人: | 旺玖科技股份有限公司 |
主分类号: | H02P6/00 | 分类号: | H02P6/00;H02P6/16;H02P6/08 |
代理公司: | 北京三友专利代理有限责任公司 | 代理人: | 韩飘扬 |
地址: | 台湾省*** | 国省代码: | 台湾;71 |
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摘要: | |||
搜索关键词: | 无刷式 直流 马达 驱动 方法 电路 | ||
1.一种无刷式直流电动机的驱动方法,以电动机定子线圈的感应磁场对电动机转子的磁极所产生的磁力的切向分力,驱动电动机转子按照预定的方向转动,在电动机转子的一磁极转动到一相对于定子磁场的临界位置后,该定子磁场的极性分布在转子磁极上产生与转子转动方向相反的切线分力,定子线圈该感应磁场的极性产生交变,驱使转子继续朝原方向转动,其特征在于包括:感测电动机转子的磁极分布;产生驱动控制信号,在转子到达临界位置前后一指定时段的禁能区间内,该驱动控制信号处于一禁能指示状态;以驱动控制信号控制定子磁场的产生与交变,当驱动控制信号处于禁能指示状态时,不产生定子磁场;以定子磁场产生的磁力驱动转子运转。
2.根据权利要求1所述的无刷式直流电动机的驱动方法,其特征在于:所述的感测电动机转子的磁极分布是由霍尔传感器进行的。
3.根据权利要求1所述的无刷式直流电动机的驱动方法,其特征在于:所述的感测电动机转子的磁极分布,包括:产生按照电动机转子磁极分布而改变的一第一感测信号及一第二感测信号,在电动机转子到达所述的临界位置前后,该第一感测信号由第一感测电位逐渐变化到第二感测电位,而第二感测信号由第二感测电位逐渐变化到第一感测电位。
4.根据权利要求1或3所述的无刷式直流电动机的驱动方法,其特征在于:所述的产生驱动控制信号进一步包括:产生一第一参考信号以决定一禁能区间,该禁能区间包含所述的临界位置;产生一对应于第一感测信号的第一非重叠信号,当第一感测信号的电位大于第一参考信号的电位时,该第一非重叠信号处于一第一控制电位,而当第一感测信号的电位小于第一参考信号的电位时,该第一非重叠信号处于一第二控制电位;产生一对应于第二感测信号的第二非重叠信号,当第二感测信号的电位大于第一参考信号的电位时,该第二非重叠信号处于一第一控制电位,而当第二感测信号的电位小于第一参考信号的电位时,该第二非重叠信号处于一第二控制电位;以第一非重叠信号及第二非重叠信号作为所述的驱动控制信号。
5.根据权利要求4所述的无刷式直流电动机的驱动方法,其特征在于:所述的第一非重叠信号及第二非重叠信号,于所述的禁能区间内处于同一电位,使电动机定子于禁能区间内不产生感应磁场。
6.根据权利要求4所述的无刷式直流电动机的驱动方法,其特征在于:所述的控制信号实现定子磁场的产生与控制,是在第一非重叠信号及第二非重叠信号处于同一电位的禁能区间内,所述的控制信号输出禁能指示电位,所述的电动机定子于该禁能指示电位下不产生感应磁场。
7.根据权利要求6所述的无刷式直流电动机的驱动方法,其特征在于:所述的定子磁场的产生与控制是以脉冲宽度调制信号进行的,该脉冲宽度调制信号将第一非重叠信号及第二非重叠信号不置于同一电位的区间,而区分为一第一速控区间及一第二速控区间,并于禁能区间及第一速控区间输出所述的禁能指示电位,而于第二速控区间输出一致能指示电位,所述的电动机定子于致能指示电位下产生感应磁场。
8.根据权利要求7所述的无刷式直流电动机的驱动方法,其特征在于:所述的第二速控区间及所述的第一速控区间的长度比例,是按照所指定的电动机转速的高低进行区分的,所指定的转速越高,第二速控区间的长度比例越大。
9.根据权利要求7所述的无刷式直流电动机的驱动方法,其特征在于:所述的定子磁场的产生与控制是以一速控调制信号进行的,所述的速控调制信号在所述的禁能区间及第二速控区间内,输出所述的禁能指示电位,而在所述的第一速控区间内,输出所述的致能电位。
10.根据权利要求4所述的无刷式直流电动机的驱动方法,其特征在于:所述的控制信号实现定子磁场的产生与控制,是由驱动电路进行的,该驱动电路至少包括:一第一比较器,包含两第一比较器输入端及一第一比较器输出端,所述的两第一比较器输入端分别与所述的第一感测信号及第一参考信号耦合;一第二比较器,包含两第二比较器输入端及一第二比较器输出端,所述的两第二比较器输入端分别与所述的第二感测信号及第一参考信号耦合;一逻辑运算器,用于将第一比较器的输出信号与第二比较器的输出信号区分出处于同一逻辑状态的时段和处于非同一逻辑状态的时段,作为驱动电动机的依据,该逻辑运算器包含二逻辑输入端及一逻辑输出端,所述的二逻辑输入端分别耦合至所述第一比较器输出端及第二比较器输出端。
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