[发明专利]减少电源损耗的方法与装置无效

专利信息
申请号: 99816591.3 申请日: 1999-12-28
公开(公告)号: CN1348558A 公开(公告)日: 2002-05-08
发明(设计)人: S·梅尔 申请(专利权)人: 艾利森电话股份有限公司
主分类号: G06F1/10 分类号: G06F1/10;G06F1/32
代理公司: 中国专利代理(香港)有限公司 代理人: 王勇,李亚非
地址: 瑞典斯*** 国省代码: 暂无信息
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摘要:
搜索关键词: 减少 电源 损耗 方法 装置
【说明书】:

                 技术领域

本发明涉及一种用于在一个设备中停用和重新开始时钟的方法和装置。本发明特别涉及要求在不活动期间取消时钟的产生以减少电源损耗的设备,例如电池供电的设备。

                 背景技术

在电池供电的产品、例如移动电话或便携式个人计算机中,节省电源以便延长电池使用寿命是很重要的。减少电源的一种方法是在不活动期间关掉处理器时钟。然而,在那些需要和一个外部设备同步操作的产品中,例如必须和一个网络同步的移动电话中,必须有至少一个时钟连续不断地运行以提供这个同步。在含有几个处理器的产品中,相对于该产品中一个或几个从处理器而言,通常指定一个处理器作为主处理器,当需要时主处理器将控制打开和关掉这些从处理器的时钟信号。然而,为了重启一个时钟,主处理器必须察觉到任何一个要求一个从处理器同步操作的事件,例如按下移动电话上的一个键,从而提供时钟信号以重新启动时钟。

在JP专利7-244650描述的一种时钟控制电路中,向一个数字无线电终端的数字信号处理器提供一个外部时钟源。该电路从该外部时钟信号中产生一个内部时钟,但是可以在不活动期间取消外部时钟的提供以节省电源。这使用一个由该时钟控制电路发出的时钟控制信号进行管理。当这个信号为高时,就将外部时钟信号提供给处理器。当由软件设置为一个低功率方式或睡眠方式时,就使由该时钟控制电路发出的时钟请求信号为低。然后就取消提供外部时钟并停止内部时钟。当该时钟控制电路收到一个中断请求,指示需要一个时钟信号时,就将时钟请求信号设置为高,于是激活内部时钟并再次提供外部时钟。

这种电路的一个问题是:在抑止外部时钟的同时到达一个异步中断可以导致内部时钟进行切换,并可能导致处理器电路进入一个禁止状态。此外,重新启动的内部时钟状态是不确定的,这是因为它取决于对一个异步请求的响应而进行的外部时钟重发。所描述电路的一个更进一步的缺点是该时钟控制设备只能够处理一个中断,这严重地限制了它的应用。

                    发明内容

因此本发明的一个目的是提供一种用于时钟控制、并克服了现有技术中相关问题的方法和装置。

本发明的一个具体目的是提供一种用于时钟控制、能使一个内部时钟信号可靠利索地停止、以及还能够响应一个异步事件而可靠利索地重新启动内部时钟信号的方法和装置。

这些和更多的目的可以在一种用于控制时钟的装置中实现,该装置包含:转换装置,用于通过该装置将一个连接设备的外部时钟转换成一个内部时钟;时钟请求产生装置,适于向一个外部时钟控制器传送请求信号。这些信号起到请求取消和重新启动该外部时钟的作用。控制装置用于:根据至少一个控制信号的预定状态,通过转换装置和时钟请求产生装置,控制内部时钟的产生。时钟请求产生装置还与一个适于接收几个输入信号的时钟开始模块相连,这些信号可以发出一个要求设备时钟操作的事件。更可取地,控制装置使用两个信号来控制时钟的取消和重新启动,一个起源于该设备,另一个在该时钟控制装置中。一旦输入了一个低功率方式,则首先停用内部时钟,然后发送一个取消外部时钟的请求。这提供了使外部时钟停用的条件,除非有一个输入信号改变了状态,这实际上会导致取消该请求。因此外部时钟保持运转,从而允许内部时钟利索地重新启动。

利用这个装置,内部时钟的控制可以从任何停止或重新启动外部时钟的请求中分离出来,并独立于它们。因此在外部时钟的控制之下、甚至是在异步请求时钟操作的情况下,能够利索、可靠地停止和重新启动内部时钟。此外,一个由任一输入信号状态变化引起的时钟请求信号能够由该电路进行控制,从而使它能够适当地阻止取消外部时钟或是启动外部时钟的重启。可以从几个输入信号中的任意一个产生单个请求信号,而利用一个或仅仅两个信号控制外部时钟意味着需要在设备和用于控制时钟产生的外部时钟控制器之间提供至多只有两个连接,而不考虑输入信号的数目。

                   附图说明

通过以下参考附图给出的最佳实施例的描述,本发明的更多目的和优点将更为明显。

图1原理性地说明了一个主设备和一个从属设备的电路概述,其中从属设备内配置有一个时钟控制模块;

图2原理性地说明了时钟控制模块的详细电路;

图3显示了一个用于该时钟控制模块中的一个状态机的真值表;

图4显示了时钟控制模块的第一时序图;以及

图5显示了时钟控制模块的第二时序图。

                  具体实施方式

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