[发明专利]用于FEC解码器的优化并行输入并行输出GF(2M)乘法器无效
| 申请号： | 01143595.X | 申请日： | 2001-12-13 |
| 公开（公告）号： | CN1360404A | 公开（公告）日： | 2002-07-24 |
| 发明（设计）人： | 迈克·雷 | 申请（专利权）人： | 美国阿尔卡塔尔资源有限合伙公司 |
| 主分类号： | H04B10/12 | 分类号： | H04B10/12;H03M13/03 |
| 代理公司： | 中国国际贸易促进委员会专利商标事务所 | 代理人： | 李德山 |
| 地址： | 美国得*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明实现了作为乘法器电路的技术优势。乘法器电路乘以GF(213)向量,以实现sigma计算以及Chien搜索。该乘法器得到两个将被相乘的输入,并且仅在一个时钟周期中,输出在(213)向量中产生的乘积。乘法器电路被定制成可以利用OC－48以及OC－192数据工作,并且满足SONET标准T1X1.5/99－218R3以及SDH标准ITU－T.G.707/Y.1322。 | ||
| 搜索关键词： | 用于 fec 解码器 优化 并行 输入 输出 gf 乘法器 | ||
【主权项】：
1.一种用于解码器中的乘法器电路，包括：一个时钟，用于在第一频率上生成多个时钟周期；以及一个乘法器模块，耦合到所述时钟并且接收2个输入，所述乘法器电路利用1个所述的时钟周期，相乘所述的2个输入，以实现只有1个时钟周期的等待时间。
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