[发明专利]非易失半导体存储器件及其制造方法无效

专利信息
申请号: 02141806.3 申请日: 2002-05-29
公开(公告)号: CN1396661A 公开(公告)日: 2003-02-12
发明(设计)人: 角田弘昭;小林英行 申请(专利权)人: 株式会社东芝
主分类号: H01L27/105 分类号: H01L27/105;H01L21/8239
代理公司: 中国国际贸易促进委员会专利商标事务所 代理人: 王永刚
地址: 日本*** 国省代码: 暂无信息
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摘要: 提供一种非易失半导体存储器件,包括具有多个存储单元的元件区和元件分隔区。其中所述存储单元包括沟道区,在所述沟道区上形成的栅绝缘膜,在所述栅绝缘膜上形成的浮置栅电极,在所述浮置栅电极上形成的第二栅绝缘膜,在所述第二栅绝缘膜上形成的控制栅电极,在水平方向夹持所述沟道区而形成的源·漏区。而且所述元件分隔区包括在与所述源·漏区夹持所述沟道区的方向基本垂直的水平方向、夹持所述沟道区而形成的元件分隔绝缘体,在与所述源·漏区夹持所述沟道区的方向基本平行的水平方向、贯通所述元件分隔绝缘体内部的导电体。
搜索关键词: 非易失 半导体 存储 器件 及其 制造 方法
【主权项】:
1.一种非易失半导体存储器件,包括具有多个存储单元的元件区和用于将所述存储单元彼此电气分隔的元件分隔区,其中,所述存储单元包括:沟道区;在所述沟道区上形成的栅绝缘膜;在所述栅绝缘膜上形成的浮置栅电极;在所述浮置栅电极上形成的第二栅绝缘膜;在所述第二栅绝缘膜上形成的控制栅电极;在水平方向夹持所述沟道区而形成的源·漏区,所述元件分隔区包括:在与所述源·漏区夹持所述沟道区的方向基本垂直的水平方向、夹持所述沟道区而形成的元件分隔绝缘体;在与所述源·漏区夹持所述沟道区的方向基本平行的水平方向、贯通所述元件分隔绝缘体内部的导电体。
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