[实用新型]具暂存器的即时时钟芯片模块无效
| 申请号： | 200620131107.0 | 申请日： | 2006-08-04 |
| 公开（公告）号： | CN201011559Y | 公开（公告）日： | 2008-01-23 |
| 发明（设计）人： | 余俊德;吴坤男 | 申请（专利权）人： | 四零四科技股份有限公司 |
| 主分类号： | G06F1/14 | 分类号： | G06F1/14 |
| 代理公司： | 中原信达知识产权代理有限责任公司 | 代理人： | 谢丽娜;陈肖梅 |
| 地址： | 中国台*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 本实用新型为一种具暂存器的即时时钟芯片模块，当主机端或控制端于欲读取即时时钟的时间标记时，由预设的中央处理器下达控制指令并将即时时钟内的外部暂存器中的时间标记静止，尔后再由该预设的中央处理器将外部暂存器的时间标记读出。该具暂存器的即时时钟芯片模块由产生时间标记的时序产生器、存入时间标记的外部暂存器、及可控制时序产生器及外部暂存器的控制器所构成，藉此，预设的中央处理器即可读取储存于外部暂存器的时间标记，因此无论预设的中央处理器是否因为运算其它程序而处于忙录的状态下，皆可准确的读取中央处理器所下达读取命令的正确时间点功效。 | ||
| 搜索关键词： | 暂存器 即时 时钟 芯片 模块 | ||
【主权项】：
1.一种具暂存器的即时时钟芯片模块，是用于电子装置的即时时钟，当预设的中央处理器于欲读取时间标记时，可将即时时钟内的外部暂存器中的时间标记静止，尔后再由该预设的中央处理器将外部暂存器的时间标记读出，其特征是：该具暂存器的即时时钟模块由控制器、时序产生器及外部暂存器所构成，该产生时间标记的时序产生器与存入时间标记的外部暂存器电性耦接；该外部暂存器与时序产生器、控制器电性耦接；该控制器与时序产生器、外部暂存器电性相耦接。
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