[发明专利]处理器无效
| 申请号： | 200680011388.9 | 申请日： | 2006-03-07 |
| 公开（公告）号： | CN101156134A | 公开（公告）日： | 2008-04-02 |
| 发明（设计）人： | 田中哲也;桧垣信生;瓶子岳人 | 申请（专利权）人： | 松下电器产业株式会社 |
| 主分类号： | G06F9/38 | 分类号： | G06F9/38;G06F9/42 |
| 代理公司： | 永新专利商标代理有限公司 | 代理人： | 胡建新 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 本发明的处理器(100)包括：主指令缓冲器(122)，存储并提供从所述指令高速缓冲存储器(10)提取的一个以上的指令；TAR用指令缓冲器(123)，存储并辅助提供从所述指令高速缓冲存储器(10)提取的一个以上的指令；选择器(121)，将一般指令缓冲器(122)及TAR用指令缓冲器(123)中的任一个选择为指令提供源；以及指令获取控制部(102)，在执行TAR用充指令的情况下，提取由TAR用充指令确定的一个以上的指令并存储到TAR用指令缓冲器(123)，在反复提供所提取的指令时，控制选择器(121)从而选择TAR用指令缓冲器(123)，通过选择器(121)使TAR用指令缓冲器(123)提供指令。 | ||
| 搜索关键词： | 处理器 | ||
【主权项】：
1.一种处理器，提取并执行存储在指令高速缓冲存储器的指令，其特征在于，包括：主指令缓冲器，存储并提供从所述指令高速缓冲存储器提取的一个以上的指令；第一子指令缓冲器，存储并辅助提供从所述指令高速缓冲存储器提取的一个以上的指令；选择器，选择所述主指令缓冲器及所述第一子指令缓冲器中的任一个，以作为指令提供源；以及指令获取控制单元，在通过所述选择器使所述主指令缓冲器提供指令、并执行第一填充指令的情况下，从第一地址提取一个以上的指令并存储到所述第一子指令缓冲器，并在反复提供从所述第一地址提取的一个以上的指令时，控制所述选择器来选择所述第一子指令缓冲器，通过所述选择器使所述第一子指令缓冲器提供指令，所述第一填充指令表示将从所述指令高速缓冲存储器的第一地址提取的一个以上的指令填充到所述第一子指令缓冲器。
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