[发明专利]镶嵌内连线结构与双镶嵌工艺有效
申请号: | 200710008111.7 | 申请日: | 2007-01-26 |
公开(公告)号: | CN101231968A | 公开(公告)日: | 2008-07-30 |
发明(设计)人: | 黄俊仁;赖育聪;姚志成;廖俊雄 | 申请(专利权)人: | 联华电子股份有限公司 |
主分类号: | H01L21/768 | 分类号: | H01L21/768;H01L21/311;H01L23/522 |
代理公司: | 北京市柳沈律师事务所 | 代理人: | 陶凤波 |
地址: | 中国台湾新竹*** | 国省代码: | 中国台湾;71 |
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摘要: | 一种双镶嵌工艺,首先提供一衬底,其具有一底层介电层、形成在该底层介电层中的下层导电层,及覆盖住该下层导电层及该底层介电层的盖层,接着,于该盖层上沉积一介电层,再于该介电层上沉积一硅氧层,再于该硅氧层上形成一金属硬掩模,接着于该金属硬掩模中形成一沟槽凹口,然后,经由该沟槽凹口,蚀刻该硅氧层与该介电层,形成通路开口,使其暴露出部分的该盖层,最后,进行一衬垫层蚀除(LRM)工艺,利用一不含氢的氟烷气体混合一含氮气体等离子,选择性地蚀除经由该通路开口暴露出来的该盖层,暴露出部分的该下层导电层。 | ||
搜索关键词: | 镶嵌 连线 结构 工艺 | ||
【主权项】:
1.一种镶嵌工艺,包含有以下的步骤:提供衬底,其具有底层介电层、形成在该底层介电层中的下层导电层,以及覆盖住该下层导电层及该底层介电层的盖层;于该盖层上沉积介电层;于该介电层中蚀刻出开口,暴露出部分的该盖层;以及进行衬垫层蚀除工艺,利用四氟化碳/三氟化氮气体等离子,选择性地蚀除经由该开口暴露出来的该盖层,以暴露出部分的该下层导电层以及该底层介电层,形成通路开口,其中于该通路开口的底部,该下层导电层及该底层介电层之间的落差仅小于150埃。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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