[发明专利]BCH纠错技术中的纠错信息处理方法及其处理装置有效
申请号: | 200710008878.X | 申请日: | 2007-04-24 |
公开(公告)号: | CN101140808A | 公开(公告)日: | 2008-03-12 |
发明(设计)人: | 阙金珍 | 申请(专利权)人: | 福州瑞芯微电子有限公司 |
主分类号: | G11C29/42 | 分类号: | G11C29/42;H03M13/15 |
代理公司: | 福州展晖专利事务所 | 代理人: | 陈如涛 |
地址: | 350011福建省福州市*** | 国省代码: | 福建;35 |
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摘要: | 本发明涉及一种用数据表示中的冗余码作错误检测或校正的编码装置,特别是一种BCH纠错技术中的纠错信息处理方法及其处理装置,一般用于闪存存储系统。本发明的要点在于提供了一种BCH纠错技术中的纠错信息处理方法及其处理装置,使得在往闪存存储系统中读取数据时,可以将纠错信息的处理与信息数据的读取分开来,在完成一页或复数页的信息数据读取后,再通过所得到的纠错信息对所读取的信息数据一次性进行纠错处理,从而实现闪存存储系统对数据读取的连续性,使操作简单化,并提高了闪存存储系统对数据读取的速度。 | ||
搜索关键词: | bch 纠错 技术 中的 信息处理 方法 及其 处理 装置 | ||
【主权项】:
1.BCH纠错技术中的纠错信息处理方法,其特征在于,包括如下步骤:▲提供一种闪存存储系统、一种闪存接口控制装置、一种纠错信息存储器和BCH解码器,闪存接口控制装置的一个读取控制端与闪存存储系统连接,另一个驱动控制端与BCH解码器传输连接,而纠错信息存储器的输出控制端连接闪存接口控制装置,输入端与BCH解码器的输出端连接,BCH解码器的输入端与闪存存储系统连接;▲闪存接口控制装置中包括有依序连接的数据处理器、计数装置、比较装置和驱动触发装置以及与比较装置的基准端连接的基准装置,其中数据处理器的读取控制端连接闪存存储系统,驱动控制端连接BCH解码器,驱动触发装置则连接纠错信息存储器的驱动触发端;▲闪存接口控制装置的数据处理器从闪存存储系统中读取一个信息位,同时该数据处理器发送一驱动信号给BCH解码器;▲BCH解码器往闪存存储系统中读取校验码进行解码处理,从而得到一纠错信息,并将该纠错信息存储到纠错信息存储器中;▲闪存接口控制装置的数据处理器在处理所读取的数据的同时,将数据信息发送给计数装置,计数装置将对写入的信息位的位数进行计算,而比较装置将计数装置所计数的结果与基准装置中的基准值进行比较,当计数结果达到基准值后,比较装置输出一控制信号给驱动触发装置,由驱动触发装置触发纠错信息存储器,将纠错信息存储器中的相应信息发送到数据处理器中,对之前所读取的对应信息数据进行纠错处理。
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