[发明专利]一种延时锁相电路无效
| 申请号： | 200710098962.5 | 申请日： | 2007-04-30 |
| 公开（公告）号： | CN101299608A | 公开（公告）日： | 2008-11-05 |
| 发明（设计）人： | 林丰成;林昕;赵显西;丁素广 | 申请（专利权）人： | 天利半导体（深圳）有限公司 |
| 主分类号： | H03L7/00 | 分类号： | H03L7/00 |
| 代理公司： | 北京三高永信知识产权代理有限责任公司 | 代理人： | 何文彬 |
| 地址： | 518067广东省深圳*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明公开了一种延时锁相电路(DLL：Delay lock line)，包括延时测试电路和延时锁相输出电路。本电路可以实现对已有确定时钟的较精确延时时间的计算，又可以实现对不确定时钟的较精确相对时间的计算，例如时钟周期的1/N，2/N，...(N－1)/N的延时。本发明所述的延时锁相电路与通用的CMOS Logic工艺完全兼容，不需要增加纯逻辑工艺之外的任何MASK。本电路在高速、低功耗和高集成度方面具备特质，适用于通信等高精度延时电路。 | ||
| 搜索关键词： | 一种 延时 电路 | ||
【主权项】：
1、一种延时锁相电路，其特征在于：包括延时测试电路和延时锁相输出电路。
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