[发明专利]非易失存储器设备有效
申请号: | 200710108258.3 | 申请日: | 2007-06-07 |
公开(公告)号: | CN101086897A | 公开(公告)日: | 2007-12-12 |
发明(设计)人: | D·S·宋;J·帕克;J·穆拉蒂 | 申请(专利权)人: | 意法半导体股份有限公司;意法半导体亚太私人有限公司;海力士半导体有限公司 |
主分类号: | G11C16/06 | 分类号: | G11C16/06 |
代理公司: | 中国专利代理(香港)有限公司 | 代理人: | 王庆海;陈景峻 |
地址: | 意大利*** | 国省代码: | 意大利;IT |
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摘要: | 对于提议的页缓冲器,在源极线上的噪声或者可能的电压浪涌不会引起编程操作的失败,并且它最后使得保存要写入到存储器设备的页的单元中的比特成为可能,同时完全可靠地在不同页上进行编程操作。缓存锁存器在编程操作和编程检验操作期间与源极线隔离。而且,主锁存器和缓存锁存器没有直接连接,而是通过临时锁存器耦接,该临时锁存器用于将来自缓存锁存器的数据传送到主锁存器中。存在于所选定的位线的源极线上的可能的噪声或者电压浪涌不能翻转保存在缓存锁存器中的比特,因为该缓存锁存器在编程或者编程检验操作期间没有连接源极线,而是将其中保存的比特通过临时锁存器传送到源极线。 | ||
搜索关键词: | 非易失 存储器 设备 | ||
【主权项】:
1.一种非易失存储器设备,其在记录或者修改所保存的数据时执行编程程序,随后执行编程检验程序,该非易失存储器设备包括:保存数据的存储器单元阵列,用于选择性连接所述阵列的位线到检测节点的选通电路,耦接到所述检测节点的页缓冲器,该页缓冲器至少包括用于保存要被写入到该存储器中的数据的主锁存器,以及用于保存提供到存储器的输入线上以便通过源极线将其传送到主锁存器的数据的缓存锁存器,其特征在于:所述页缓冲器还包括通过所述源极线直接连接到所述主锁存器和通过辅助开关直接连接到所述缓存寄存器的临时静态锁存器;在执行所述编程程序和所述编程检验程序期间,所述缓存锁存器与所述源极线隔离;所述直接连接的临时静态锁存器在所述主锁存器和缓存锁存器之间传送数据。
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