[发明专利]主机板及其内存装置有效
| 申请号： | 200710110414.X | 申请日： | 2007-06-05 |
| 公开（公告）号： | CN101320589A | 公开（公告）日： | 2008-12-10 |
| 发明（设计）人： | 陈约志 | 申请（专利权）人： | 华硕电脑股份有限公司 |
| 主分类号： | G11C5/00 | 分类号： | G11C5/00;G11C8/12;G06F13/00 |
| 代理公司： | 北京市柳沈律师事务所 | 代理人： | 黄小临;王志森 |
| 地址： | 中国台*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 一种内存装置，其可以直接植在现今任一可支持第三代双通道同步动态随机存储器DDR3 SDRAM的主机板上，以将JEDEC所制定的fly－by总线架构及T型支流架构的优点整合，藉此来提升桌上型计算机单位时间内的系统效能。 | ||
| 搜索关键词： | 主机板 及其 内存 装置 | ||
【主权项】：
1.一种内存装置，其特征是包括：多数个内存芯片，上述这些内存芯片分为一第一群组的内存芯片及一第二群组的内存芯片；一第一指令/地址线，具有一第一分支点与多数个第一分歧点，其中上述第一分支点位于上述第一指令/地址线的中心，且每一个第一分歧点对应的连接至上述第一群组的内存芯片其中之一，而上述这些第一分歧点间的一第一线段长度等长；一第二指令/地址线，具有一第二分支点与多数个第二分歧点，其中上述第二分支点位于上述第二指令/地址线的中心，且每一个第二分歧点对应的连接至上述第二群组的内存芯片其中之一，而上述这些第二分歧点间的一第二线段长度与上述第一线段长度等长；一第三指令/地址线，具有一第三分支点与两个第三分歧点，其中上述第三分支点位于上述第三指令/地址线的中心，并距离上述这些第三分歧点的一第三线段长度等长，且其中一个第三分歧点连接至上述第一分支点，而另一个第三分歧点连接至上述第二分支点；一第一终端器，连接于上述第一分支点；以及一第二终端器，连接于上述第二分支点。
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