[发明专利]支持动态字节长度的存储器存取装置无效
申请号: | 200710111545.X | 申请日: | 2007-06-19 |
公开(公告)号: | CN101330293A | 公开(公告)日: | 2008-12-24 |
发明(设计)人: | 邓致超 | 申请(专利权)人: | 佑华微电子股份有限公司 |
主分类号: | H03M7/30 | 分类号: | H03M7/30 |
代理公司: | 中科专利商标代理有限责任公司 | 代理人: | 汤保平 |
地址: | 台湾省*** | 国省代码: | 中国台湾;71 |
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摘要: | 本发明揭露一种支持动态字节长度的存储器存取装置,特别是支持动态调整字节长度的编码/解码系统的并行式存储器储存与读取功能。本发明的存储器存取装置,是一种新的并行式存储器的存取方式,为并串并(parallel to serial toparallel,PSP)的存取方式,可由并行式方式储存存储器,避免编解码系统的兼容性问题与其它元件的兼容性问题,强化资料定址功能。本发明的存储器存取装置,通过并接输入串接输出模组与串接输入并接输出模组的组合,让资料得以串行序列方式转移或传送,将资料线宽度需求不一的编码器、解码器、与并行式存储器等元件连接起来,以实现存取与定址功能。 | ||
搜索关键词: | 支持 动态 字节 长度 存储器 存取 装置 | ||
【主权项】:
1、一种支持动态字节长度的存储器存取装置,是应用在编码储存系统中,其特征在于,该装置包含:至少一个编码器;一并接输入串接输出模组,一次接收任一该编码器输出的n比特资料,并将该n比特资料转换为一相对应的序列资料输出,n为自然数;一串接输入并接输出模组,是以1比特的资料线宽度接收该并接输入串接输出模组输出的该序列资料,同时输出m比特资料,m为自然数;以及一并行式存储器,是以m比特数据总线宽度一次接收该串接输入并接输出模组输出的该m比特资料。
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