[实用新型]一种高速可配置扩展SPI总线无效
| 申请号： | 200720021370.9 | 申请日： | 2007-05-29 |
| 公开（公告）号： | CN201060487Y | 公开（公告）日： | 2008-05-14 |
| 发明（设计）人： | 胡天亮;张承瑞;武洪恩;李鹏 | 申请（专利权）人： | 山东大学 |
| 主分类号： | G06F13/40 | 分类号： | G06F13/40 |
| 代理公司： | 济南圣达专利商标事务所 | 代理人： | 张勇 |
| 地址： | 250061*** | 国省代码： | 山东;37 |
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| 摘要： | 本实用新型公开了一种高速可配置扩展SPI总线及其工作方法。其结构为：它有至少一个主模块及至少一个从模块，以及SPI总线中的SCLK时钟输出信号线、MOSI数据线、MISO数据线、SS选通信号线以及配置信号线SCFG，主模块内设有可变长总线发送/接收器FPGA/CPLD，从模块内设有总线接收/发送器FPGA/CPLD，它们组成总线配置收发器；主模块可变长总线发送/接收器FPGA/CPLD通过串行级联配置信号线SCFG与其中一个从模块的总线接收/发送器FPGA/CPLD连接，该从模块总线接收/发送器FPGA/CPLD则通过配置信号线SCFG与其它从模块总线接收/发送器FPGA/CPLD相互串联；同时主模块的SPI总线还通过屏蔽双绞线与其他从模块连接，并对SPI总线信号进行差分处理。可对任何子模块的扩展和改变进行在线识别和配置，并协调各模块同步动作。 | ||
| 搜索关键词： | 一种 高速 配置 扩展 spi 总线 | ||
【主权项】：
1.一种高速可配置扩展SPI总线，它有至少一个主模块及至少一个从模块，以及SPI总线中的SCLK时钟输出信号线、MOSI数据线、MISO数据线、SS选通信号线以及配置信号线SCFG，其特征是：所述主模块内设有可变长总线发送/接收器器FPGA/CPLD，从模块内设有总线接收/发送器FPGA/CPLD，它们共同组成总线配置收发器；主模块可变长总线发送/接收器FPGA/CPLD通过串行级联配置信号线SCFG与其中一个从模块的总线接收/发送器FPGA/CPLD连接，该从模块总线接收/发送器FPGA/CPLD则通过配置信号线SCFG与其它从模块总线接收/发送器FPGA/CPLD相互串联，通过通信协议和可编程逻辑设计进行数据报文的可变长度传输和从模块的柔性在线配置；同时主模块的SPI总线还通过屏蔽双绞线与其他从模块连接，并对SPI总线信号进行差分处理，实现数据包的高速长距离的一主多从通讯。
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