[发明专利]电路器件中的动态时序调整无效
| 申请号： | 200780007829.2 | 申请日： | 2007-01-29 |
| 公开（公告）号： | CN101535917A | 公开（公告）日： | 2009-09-16 |
| 发明（设计）人： | A·M·雅拉尔;C·麦克唐纳 | 申请（专利权）人： | 飞思卡尔半导体公司 |
| 主分类号： | G06F1/12 | 分类号： | G06F1/12 |
| 代理公司： | 中国国际贸易促进委员会专利商标事务所 | 代理人： | 屠长存 |
| 地址： | 美国得*** | 国省代码： | 美国;US |
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| 摘要： | 一种方法，包括确定代表在第一时刻电路器件的操作速度的第一操作特性(502)。该方法进一步包括在电路器件的第一锁存器的输入端接收输入信号(504)并且在电路器件的第二锁存器的输入端接收输出信号(506)。该方法另外包括通过第一延迟来延迟时钟信号以提供第一被调整的时钟信号(508)以及通过第二延迟来延迟该时钟信号以提供第二被调整的时钟信号(510)。在一个实施例中，第一延迟和第二延迟基于第一操作特性(508、510)。该方法进一步包括响应于第一被调整的时钟信号来在第一锁存器锁存输入信号(512)以及响应于第二被调整的时钟信号来在第二锁存器锁存输出信号(514)。 | ||
| 搜索关键词： | 电路 器件 中的 动态 时序 调整 | ||
【主权项】：
1. 一种方法，包括：确定代表电路器件的操作速度的操作特性；基于该操作特性调整第一时钟信号的等待时间，该第一时钟信号控制该电路器件的第一逻辑电路的时序；以及基于该操作特性调整第二时钟信号的等待时间，该第二时钟信号控制该电路器件的第二逻辑电路的时序，其中该第二逻辑电路与该第一逻辑电路不同。
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