[发明专利]超深沟槽的多级刻蚀与填充方法有效
申请号: | 200810044051.9 | 申请日: | 2008-12-04 |
公开(公告)号: | CN101752225A | 公开(公告)日: | 2010-06-23 |
发明(设计)人: | 钱文生;王飞 | 申请(专利权)人: | 上海华虹NEC电子有限公司 |
主分类号: | H01L21/02 | 分类号: | H01L21/02;H01L21/20;H01L21/336 |
代理公司: | 上海浦一知识产权代理有限公司 31211 | 代理人: | 周赤 |
地址: | 201206 上*** | 国省代码: | 上海;31 |
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摘要: | 本发明公开了一种超深沟槽的多级刻蚀和填充方法,所述超深沟槽为20μm以上深度的沟槽,本发明是将超深沟槽由下至上地分解成多级沟槽,每级沟槽深度设定在现有的刻蚀和外延填充工艺允许的深度。并将沟槽填充工艺由CVD或PVD填充多晶硅改为外延生长单晶硅,改善填充效果。本发明还利用氧化硅作为每级沟槽刻蚀的硬光刻版和单晶硅外延的选择性隔离层。在每级沟槽外延填充完成后去除氧化硅层,并通过CMP实现平坦化,保证下一级沟槽的单晶硅外延质量。本发明采用一种多级刻蚀、多级外延填充最终形成超深沟槽的方法,解决了超深沟槽在刻蚀上和填充上的工艺困难。 | ||
搜索关键词: | 深沟 多级 刻蚀 填充 方法 | ||
【主权项】:
一种超深沟槽的多级刻蚀与填充方法,所述超深沟槽为20μm以上深度的沟槽,其特征是:该方法包括如下步骤:第1步,将超深沟槽由下至上地分解为第1级沟槽到第n级沟槽,n为大于等于2的整数,所述第1级沟槽到第n级沟槽的深度之和为超深沟槽的深度;第2步,在N型硅衬底(10)上外延淀积一层N型外延层(11),所述N型外延层(11)的厚度大于第1级沟槽的深度,再在N型外延层(11)上淀积一层氧化硅(12);第3步,采用光刻和刻蚀工艺在硅片上刻蚀掉氧化硅(12)和部分N型外延层(11),直至刻蚀掉的N型外延层(11)的深度为第1级沟槽(21)的深度,形成第1级沟槽(21);第4步,在第1级沟槽(21)内以外延工艺淀积一层P型单晶硅(13),该层P型单晶硅(13)高出N型外延层(11)的表面;第5步,先去除氧化硅(12),再采用化学机械抛光工艺平坦化P型单晶硅(13)直至与N型外延层(11)的表面齐平;第6步,在N型外延层(11)上再外延淀积一层N型外延层(14),所述N型外延层(14)的厚度等于第二级沟槽(22)的深度,再在N型外延层(14)上淀积一层氧化硅(15);第7步,采用光刻和刻蚀工艺在硅片上刻蚀掉氧化硅(15)和部分N型外延层(14),直至刻蚀掉部分P型单晶硅(13),形成第2级沟槽(22);第8步,在第2级沟槽(22)内以外延工艺淀积一层P型单晶硅(16),该层P型单晶硅(16)高出N型外延层(14)的表面;第9步,先去除氧化硅(15),再采用化学机械抛光工艺平坦化P型单晶硅(16)直至与N型外延层(14)的表面齐平;重复第6~9步直至完成第n级沟槽的刻蚀与填充。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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