[发明专利]InP衬底上集成增强型和耗尽型HEMT的制作方法无效
申请号: | 200810057889.1 | 申请日: | 2008-02-20 |
公开(公告)号: | CN101515568A | 公开(公告)日: | 2009-08-26 |
发明(设计)人: | 戴扬;杜睿;张扬;杨富华 | 申请(专利权)人: | 中国科学院半导体研究所 |
主分类号: | H01L21/8232 | 分类号: | H01L21/8232 |
代理公司: | 中科专利商标代理有限责任公司 | 代理人: | 周国城 |
地址: | 100083北*** | 国省代码: | 北京;11 |
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摘要: | 本发明提出一种在InP衬底上集成增强型和耗尽型HEMT(高电子迁移率晶体管)的制作方法,此方法适用于需要同时集成增强型HEMT和耗尽型HEMT的InP基集成电路。其特征在于:a)在InAlAs有源层和n+InGaAs帽层之间生长双AlAs阻挡层;b)采用选择腐蚀在两层AlAs阻挡层之间形成两种不同厚度、不同结构的势垒层;c)在两种不同的势垒层上分别制作两种不同结构的栅电极,分别形成增强型和耗尽型的HEMT。 | ||
搜索关键词: | inp 衬底 集成 增强 耗尽 hemt 制作方法 | ||
【主权项】:
1.一种在InP衬底上集成增强型和耗尽型HEMT的制作方法,其特征在于,包括以下步骤:1)采用半绝缘材料作为衬底;2)在衬底上生长缓冲层;3)在缓冲层上生长电子沟道层;4)在电子沟道层上生长空间层;5)在空间层上生长掺杂层;6)在掺杂层上生长第一层势垒层;7)在第一层势垒层上生长第一层腐蚀阻挡层;8)在第一层腐蚀阻挡层上生长第二层势垒层;9)在第二层势垒层上生长第二层腐蚀阻挡层;10)在第二层腐蚀阻挡层上生长帽层。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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