[发明专利]一种用以储存目标地址的分支目标缓冲器系统及方法有效
| 申请号： | 200810083742.X | 申请日： | 2008-03-10 |
| 公开（公告）号： | CN101533344A | 公开（公告）日： | 2009-09-16 |
| 发明（设计）人： | 王得安 | 申请（专利权）人： | 王得安 |
| 主分类号： | G06F9/38 | 分类号： | G06F9/38 |
| 代理公司： | 北京银龙知识产权代理有限公司 | 代理人： | 许 静 |
| 地址： | 台湾省*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 一种用以储存目标地址的分支目标缓冲器系统及方法，应用于16位元、32位元、64位元或更多位元的处理器架构，分支指令的目标地址储存环境，在储存分支指令的目标地址时，分支目标缓冲器无须储存目标地址的全部位元，而仅须储存目标地址的变动范围、进位位元、以及减/加位元。由于本发明的分支目标缓冲器无须储存分支指令地址与目标地址相似的部分，因而减少了分支目标缓冲器所须储存的目标地址栏位的位元个数。本发明虽使用较少的目标地址栏位位元个数，但确可产生出完整的目标地址，而并无运算效能的损失。 | ||
| 搜索关键词： | 一种 用以 储存 目标 地址 分支 缓冲器 系统 方法 | ||
【主权项】：
1. 一种用以储存目标地址的分支目标缓冲器方法，应用在16位元、32位元、64位元或更多位元的处理器架构，其特征在于，包含以下程序：判别、设定分支指令地址与目标地址的相同的地址栏位部分；在查找分支目标缓冲器时，通过判断出的进位位元值、以及减/加位元值，使指令地址加1单元对所送达的目标地址的变动范围以上的部分执行加1的运算，或，使指令地址减1单元对所送达的指令地址的某些部份执行减1的运算，又或者，指令地址加1单元、以及指令地址减1单元无须执行任何运算，视进位位元值、以及减/加位元值而定，指令地址加1单元或指令地址减1单元，对目标地址的变动范围以上的部分执行加1或减1的运算后，且将所运算的结果输回至分支目标缓冲器；以及分支目标缓冲器将分支指令地址与目标地址的相同部份、以及经运算后的目标地址的变动范围以上的部分予以组合成目标地址并予以输出。
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