[发明专利]电平变换电路无效
| 申请号： | 200810093012.8 | 申请日： | 2005-03-24 |
| 公开（公告）号： | CN101304252A | 公开（公告）日： | 2008-11-12 |
| 发明（设计）人： | 永田恭一 | 申请（专利权）人： | 尔必达存储器株式会社 |
| 主分类号： | H03K19/0185 | 分类号： | H03K19/0185 |
| 代理公司： | 中原信达知识产权代理有限责任公司 | 代理人： | 谷惠敏;钟强 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
| 权利要求书： | 查看更多 | 说明书： | 查看更多 |
| 摘要： | 独立的控制信号被传输到驱动器控制单元和输出晶体管的每一个，以便防止驱动器控制单元和输出晶体管在同时工作并且减小直通电流。因为晶体管比率可以被容易地选择，因此增加了设计灵活性程度，并取得速度方面的改善。 | ||
| 搜索关键词： | 电平 变换 电路 | ||
【主权项】：
1.一种电平变换电路，包括：输出单元，该输出单元包括用于输出第一电源电平大幅值信号的第一晶体管和用于输出第二电源电平大幅值信号的第二晶体管；PMOS侧电源控制单元，包含第三和第四晶体管的；以及NMOS侧电源控制单元，包含第五和第六晶体管，其中，当第一晶体管被接通时，第三晶体管被接通，在第二电源电平大幅值输出信号被导致跃迁到第一电源电平大幅值输出信号之后，第三晶体管被截止，并且第四晶体管被接通，以及当第二晶体管被接通时，在第一电源电平大幅值输出信号被导致跃迁到第二电源电平大幅值输出信号之后，第五晶体管被截止，并且第六晶体管被接通。
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