[实用新型]一种时钟降抖动电路及数字高清电视无效
| 申请号： | 200820093060.2 | 申请日： | 2008-03-27 |
| 公开（公告）号： | CN201194413Y | 公开（公告）日： | 2009-02-11 |
| 发明（设计）人： | 石进 | 申请（专利权）人： | 深圳市同洲电子股份有限公司 |
| 主分类号： | H04N7/015 | 分类号： | H04N7/015;H03L7/18 |
| 代理公司： | 深圳中一专利商标事务所 | 代理人： | 张全文 |
| 地址： | 518057广东省深圳*** | 国省代码： | 广东;44 |
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| 摘要： | 本实用新型适用于高清数字电视技术领域，旨在解决现有的技术方案物料成本高及产品的研发周期长的问题。本实用新型提供了一种时钟降抖动电路，包括一压控晶体振荡器，所述压控晶体振荡器的输出端连接一锁相环的输入端，所述锁相环的输出端连接一时钟降抖动芯片的一输入端，所述时钟降抖动芯片的另一输入端接输入时钟，所述时钟降抖动芯片一输出端连接所述压控晶体振荡器的输入端，另一输出端输出锁相环倍频后的低抖动时钟。通过本实用新型实施例可有效的降低了产品的物料成本，在开发过程中，较低频率的压控晶体振荡器需要物料的普通性也加速了产品研发周期，从而进一步降低了整体的产品成本。 | ||
| 搜索关键词： | 一种 时钟 抖动 电路 数字 电视 | ||
【主权项】：
1.一种时钟降抖动电路，其特征在于，包括一产生低抖动的低频率时钟的压控晶体振荡器，所述压控晶体振荡器的输出端连接一锁相环的输入端，所述锁相环将压控晶体振荡器输出的低抖动的低频率时钟倍频并输出，所述锁相环的输出端连接一时钟降抖动芯片的一输入端，所述时钟降抖动芯片的另一输入端接输入时钟，所述时钟降抖动芯片比较输入时钟及锁相环倍频后的低抖动时钟的频率及相位，所述时钟降抖动芯片一输出端连接所述压控晶体振荡器的输入端，另一输出端输出锁相环倍频后的低抖动时钟。
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