[实用新型]实时时钟电路无效

专利信息
申请号: 200820153394.4 申请日: 2008-09-24
公开(公告)号: CN201262720Y 公开(公告)日: 2009-06-24
发明(设计)人: 刘红梅 申请(专利权)人: 上海国宽信息科技有限公司
主分类号: G06F1/14 分类号: G06F1/14
代理公司: 上海新天专利代理有限公司 代理人: 王敏杰
地址: 201203上海市郭*** 国省代码: 上海;31
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摘要: 实用新型涉及一种实时时钟电路,包括时钟芯片、第一二极管、第二二极管和第一法拉电容,所述时钟芯片设有主电源引脚VDD、电池引脚VBAT、接地引脚VSS、串行时钟输入引脚SCL、串行数据输入/输出引脚SDA、方波/输出驱动器引脚SQW/OUT和晶体引脚X1、X2;所述第一二极管与第二二极管串联,所述第一二极管的正极与外部主用电源VCC连接,所述第二二极管的负极与时钟芯片的主电源引脚VDD连接;所述第一法拉电容的正极连接第一二极管的负极,其负极与地连接。本实用新型实时时钟电路精确度高,可靠性强,可用于复费率电度表、IC卡水表、IC卡煤气表、移动电话、便携仪器、传真机、电池电源产品和电视机。
搜索关键词: 实时 时钟 电路
【主权项】:
1、一种实时时钟电路,包括时钟芯片(1),所述时钟芯片(1)设有主电源引脚VDD、电池引脚VBAT和接地引脚VSS,其特征在于,还包括第一二极管(21)、第二二极管(22)和第一法拉电容(31);所述第一二极管(21)与第二二极管(22)串联,所述第一二极管(21)的正极与外部主用电源VCC连接,所述第二二极管(22)的负极与时钟芯片(1)的主电源引脚VDD连接;所述电池引脚VBAT与主电源引脚VDD连接;所述第一法拉电容(31)的正极连接第一二极管(21)的负极,其负极与地连接,所述接地引脚VSS与地连接。
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