[实用新型]基于全数字逻辑电路的空间有效载荷信道编码控制系统无效
申请号: | 200820180643.9 | 申请日: | 2008-12-05 |
公开(公告)号: | CN201418077Y | 公开(公告)日: | 2010-03-03 |
发明(设计)人: | 白云飞;陈晓敏;孙辉先;滕学剑;汪大星;安军社 | 申请(专利权)人: | 中国科学院空间科学与应用研究中心 |
主分类号: | H04L1/00 | 分类号: | H04L1/00;H04L29/06 |
代理公司: | 北京法思腾知识产权代理有限公司 | 代理人: | 杨小蓉 |
地址: | 100084北*** | 国省代码: | 北京;11 |
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摘要: | 本实用新型涉及一种基于全数字逻辑电路的空间有效载荷信道编码控制系统,包括系统时钟单元分别与速率调控单元、数据调度单元、纠错编码单元和数据转换单元接口电连接;数据调度单元根据各通路载荷数据流量,结合速率调控单元的系统速率调控状态信号,调度数据信号流向;纠错编码单元接受任务源信号C控制,读取数据转换单元转来载荷总线数据,对其实施交错信道编码;数据转换单元接受数据调度单元控制,将各载荷数据源信号B转送至载荷数据总线;数据聚合单元接收经纠错编码单元控制生成的编码数据,与任务源信号D合成数据传输帧,经端口控制输出。该系统特别适合空间嵌入式系统用,可靠性和稳定性高,所需空间资源少、能源消耗低。 | ||
搜索关键词: | 基于 数字 逻辑电路 空间 有效 载荷 信道编码 控制系统 | ||
【主权项】:
1、一种基于全数字逻辑电路的空间有效载荷信道编码控制系统,包括:系统时钟单元(1),为系统提供用于运行的基本工作时钟;所述的系统时钟单元(1)分别与速率调控单元(2)、数据调度单元(3)、纠错编码单元(4)和数据转换单元(5)接口电连接;速率调控单元(2),接受任务源信号(A)控制,切换系统输出数据速率,并与数据调度单元(3)和数据转换单元(5)以及数据聚合单元(6)接口电连接,为数据调度单元(3)提供系统速率调控状态信号,为数据聚合单元(6)提供数据输出速率信号,为数据转换单元(5)提供载荷时钟信号监测;数据调度单元(3),根据各通路载荷数据输入流量,以及结合速率调控单元(2)的系统速率调控状态信号,调度数据转换单元(5)的载荷数据信号流向;纠错编码单元(4),接受任务源信号(C)控制,设置纠错编码的交错深度,用于控制数据转换单元(5)转来的各通路的载荷输入数据实施纠错编码;数据转换单元(5),接收各载荷数据源信号(B),用于串行输入数据流的串/并转换和数据缓冲,提供各载荷数据输入状态,并接受数据调度单元(3)的控制,将各载荷数据转送至载荷数据总线;数据聚合单元(6),接收经过纠错编码单元(4)控制生成的纠错编码数据,与任务源信号(D)合成数据传输帧数据信号,经数据聚合单元(6)的端口(E)控制发送输出。
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