[发明专利]低密度奇偶校验卷积码编码器和低密度奇偶校验卷积码解码器有效
| 申请号： | 200880021515.2 | 申请日： | 2008-07-11 |
| 公开（公告）号： | CN101689866A | 公开（公告）日： | 2010-03-31 |
| 发明（设计）人： | 冈村周太;村上丰;折桥雅之 | 申请（专利权）人： | 松下电器产业株式会社 |
| 主分类号： | H03M13/19 | 分类号： | H03M13/19;H03M13/23 |
| 代理公司： | 北京市柳沈律师事务所 | 代理人： | 郑海涛 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 公开了削减进行LDPC-CC(Low-Density Parity-Check ConvolutionalCodes：低密度奇偶校验卷积码)编码和解码所需的终止序列的量，抑制传输效率的劣化，并且进行纠错编码和纠错解码的LDPC-CC编码器和LDPC-CC解码器。在LDPC-CC编码器(400)中，加权控制单元(470)存储以LDPC-CC校验矩阵(100)为基准的加权图案(475)以及以变形了LDPC-CC校验矩阵(100)所得的校验矩阵(300)为基准的加权图案(476)，在输入比特为信息序列时，使用加权图案(475)，在输入比特为终止序列时，使用使与校验比特v2，t相乘的加权值为0的加权图案(476)，控制与多个移位寄存器(410-1至410-M以及430-1至430-M)的输出相乘的权重。 | ||
| 搜索关键词： | 密度 奇偶校验 卷积码 编码器 解码器 | ||
【主权项】：
1.低密度奇偶校验卷积码编码器，包括：多个移位寄存器；多个加权乘法单元，将权重乘以所述移位寄存器的输出；逻辑异或运算器，对所述多个加权乘法单元的输出进行逻辑异或运算；比特数计数器，对进行编码的输入比特的比特数进行计数；以及加权控制单元，根据所述比特数，控制所述多个加权乘法单元的权重。
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