[发明专利]具有整数和分数时间分辨力的可编程延迟电路无效
| 申请号： | 200880121419.5 | 申请日： | 2008-12-18 |
| 公开（公告）号： | CN101904099A | 公开（公告）日： | 2010-12-01 |
| 发明（设计）人： | 穆斯塔法·克斯金;马尔奇奥·佩德拉里-诺伊 | 申请（专利权）人： | 高通股份有限公司 |
| 主分类号： | H03K5/13 | 分类号： | H03K5/13 |
| 代理公司： | 北京律盟知识产权代理有限责任公司 11287 | 代理人： | 刘国伟 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 本发明描述一种能够提供具有整数和分数时间分辨力的延迟的可编程延迟电路。在一个示范性设计中，一种设备包括第一和第二延迟电路。所述第一延迟电路提供整数数目个时间单位的第一延迟。所述第二延迟电路耦合到所述第一延迟电路，且提供为一个时间单位的分数的第二延迟。所述第一延迟电路可包括串联耦合的多个单位延迟单元。每一单位延迟单元可在被启用时提供一个时间单位的延迟。所述第二延迟电路可具有第一和第二路径。所述第一路径可在被选择时提供较短延迟，且所述第二路径可在被选择时提供较长延迟。所述第二路径可耦合到至少一个虚设逻辑门，所述至少一个虚设逻辑门提供额外负载，以获得所述第二路径的所述较长延迟。 | ||
| 搜索关键词： | 具有 整数 分数 时间 分辨力 可编程 延迟 电路 | ||
【主权项】：
一种设备，其包含：第一延迟电路，其提供整数数目个时间单位的第一延迟；以及第二延迟电路，其耦合到所述第一延迟电路，且提供为一个时间单位的分数的第二延迟。
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