[发明专利]混合并行/串行总线接口无效
申请号: | 200910004405.1 | 申请日: | 2002-11-19 |
公开(公告)号: | CN101488758A | 公开(公告)日: | 2009-07-22 |
发明(设计)人: | 约瑟·葛瑞丹;艾佛瑞·史达福利;堤摩西·A·亚瑟尼司 | 申请(专利权)人: | 美商内数位科技公司 |
主分类号: | H03M9/00 | 分类号: | H03M9/00;H04L25/14;G06F13/40 |
代理公司: | 上海专利商标事务所有限公司 | 代理人: | 陆 嘉 |
地址: | 美国特*** | 国省代码: | 美国;US |
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摘要: | 一种混合并行/串行总线接口,此者具有一数据区块解多路复用装置。该数据区块解多路复用装置具有一输入,此者经配置设定以接收一数据区块,并将该数据区块解多路复用成多个细块。对于各个细块,一并行转串行转换器可将该细块转化成串行数据。一线路可传送各个细块的串行数据。一串行转并行转换器可转换各细块的串行数据以复原该细块。数据区块重建装置可将各复原细块合并成该数据区块。 | ||
搜索关键词: | 混合 并行 串行 总线接口 | ||
【主权项】:
1. 一种用户设备,其包含:增益控制控制器,用于产生具有代表控制函数的n控制比特的控制区块;控制区块转换装置,具有被配置为接收所述控制区块的输入,并将所述控制区块转换成i个群组,其中i为实数整数且i≥2,每个群组具有多组m个控制比特;对每个群组:增附m个控制比特至所述群组用作开始位,其中m为实数整数且m≥2;第一并行至串行转换器,用于将所述控制比特和所述群组的开始位转换为串行格式;用于传送串行的控制和开始位的线路;以及第一串行至并行转换器,用于转换所述群组串行的控制比特和开始位以复原所述群组;数据区块重建装置,用于将所述复原的群组与其相关的开始位合并成所述数据区块;以及控制器,当信号应用至所述控制器时用于执行给定函数,所述给定函数代表所述开始位的共集状态的im+1-1个函数其中之一。
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