[实用新型]一种基于FPGA的税控收款机无效
| 申请号： | 200920025963.1 | 申请日： | 2009-05-27 |
| 公开（公告）号： | CN201397549Y | 公开（公告）日： | 2010-02-03 |
| 发明（设计）人： | 于治楼 | 申请（专利权）人： | 浪潮电子信息产业股份有限公司 |
| 主分类号： | G07G1/12 | 分类号： | G07G1/12;G05B19/05 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 250014*** | 国省代码： | 山东;37 |
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| 摘要： | 本实用新型公开了一种基于FPGA的税控收款机，属于一种税控收款机，其硬件包括FPGA芯片、RAM存储器、FLASH程序存储器、税控数据存储器；其中FPGA芯片中集成32位主控制器IP核、键盘扫描控制器IP核、LCD显示控制器IP核、ISO7816控制器IP核、ISO7811控制器IP核、USB控制器IP核、以太网控制器IP核、加解密控制器IP核。本实用新型的一种基于FPGA的税控收款机和现有技术相比，具有可配置、扩展性好、安全性高、可靠性高等特点。 | ||
| 搜索关键词： | 一种 基于 fpga 收款机 | ||
【主权项】：
1、一种基于FPGA的税控收款机，其特征在于硬件包括FPGA芯片、RAM存储器、FLASH程序存储器、税控数据存储器；其中FPGA芯片中集成32位主控制器IP核、键盘扫描控制器IP核、LCD显示控制器IP核、ISO7816控制器IP核、ISO7811控制器IP核、USB控制器IP核、以太网控制器IP核、加解密控制器IP核；键盘扫描控制器IP核、LCD显示控制器IP核、ISO7816控制器IP核、ISO7811控制器IP核、USB控制器IP核、以太网控制器IP核、加解密控制器IP核均由32位主控制器IP核控制。
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