[实用新型]SDR存储器与DDR存储器兼容电路无效

专利信息
申请号: 200920183140.1 申请日: 2009-09-29
公开(公告)号: CN201508692U 公开(公告)日: 2010-06-16
发明(设计)人: 林旭 申请(专利权)人: 福建新大陆通信科技有限公司
主分类号: G11C7/10 分类号: G11C7/10
代理公司: 福州市鼓楼区京华专利事务所(普通合伙) 35212 代理人: 翁素华
地址: 350000 福*** 国省代码: 福建;35
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摘要: 一种SDR存储器与DDR存储器兼容电路,包括SDR存储器、DDR存储器、电阻RM1、RM2,电阻RM18,以及内存电源控制器件,DDR存储器的参考电源脚接到电阻RM1及电阻RM2之间的节点,电阻RM2的另一端接地,电阻RM1的另一端接内存电源控制器件的第一端,内存电源控制器件的第二端接3.3V电源,内存电源控制器件的第一端作为VDD输出端,电阻RM18接在DDR存储器的差分时钟信号引脚之间。使用SDR存储器时,内存电源控制器件使用磁珠。使用DDR存储器时,内存电源控制器件采用二极管。本实用新型的优点在于:将SDR及DDR做成兼容形式,一套PCB板即可实现,节约了成本,通用性高,各类电子产品均可使用,使用简单方便,缩短了产品开发周期,提高了电子产品的市场竞争力。
搜索关键词: sdr 存储器 ddr 兼容 电路
【主权项】:
一种SDR存储器与DDR存储器兼容电路,其特征在于:包括SDR存储器、DDR存储器、电阻RM1、RM2,电阻RM18,以及内存电源控制器件,所述DDR存储器的参考电源脚接到电阻RM1及电阻RM2之间的节点,电阻RM2的另一端接地,电阻RM1的另一端接内存电源控制器件的第一端,内存电源控制器件的第二端接3.3V电源,内存电源控制器件的第一端作为VDD输出端,电阻RM18接在DDR存储器的差分时钟信号引脚之间。
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