[发明专利]用以在DDR DRAM写入期间三态控制未使用数据字节的方法、系统及设备有效
| 申请号： | 200980154657.0 | 申请日： | 2009-11-17 |
| 公开（公告）号： | CN102282619A | 公开（公告）日： | 2011-12-14 |
| 发明（设计）人： | J·费里;G·居特里 | 申请（专利权）人： | ATI技术无限责任公司 |
| 主分类号： | G11C7/10 | 分类号： | G11C7/10;G11C11/4063;G11C8/18 |
| 代理公司： | 北京戈程知识产权代理有限公司 11314 | 代理人： | 程伟;王锦阳 |
| 地址： | 加拿大*** | 国省代码： | 加拿大;CA |
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| 摘要： | 一种内存接口电路，其包含多个数据总线驱动器与经设计成可操作地回应写入驱动器屏蔽信息的逻辑。若需要，可将该等总线写入驱动器及逻辑实现于个别的集成电路。该等总线驱动器经设计成可回应写入操作。也可将该逻辑设计成在该写入操作期间基于该写入驱动器屏蔽信息来去能该等数据总线驱动器中的任一者。 | ||
| 搜索关键词： | 用以 ddr dram 写入 期间 三态 控制 使用 数据 字节 方法 系统 设备 | ||
【主权项】：
一种内存接口电路，包括：逻辑，经设计成可操作地回应写入驱动器屏蔽信息以及在写入操作期间基于该写入驱动器屏蔽信息来去能多个数据总线驱动器中的任一者。
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