[发明专利]用于电沉积铜的工艺,在穿硅通孔(TSV)中的芯片间、芯片到晶片间和晶片间的互连有效
申请号: | 200980156992.4 | 申请日: | 2009-12-16 |
公开(公告)号: | CN102318041A | 公开(公告)日: | 2012-01-11 |
发明(设计)人: | 罗伯特·F·普赖塞尔 | 申请(专利权)人: | 埃托特克德国有限公司 |
主分类号: | H01L21/288 | 分类号: | H01L21/288;H01L21/768;C25D3/38;C25D5/18;C25D7/12 |
代理公司: | 隆天国际知识产权代理有限公司 72003 | 代理人: | 姜燕;邢雪红 |
地址: | 德国*** | 国省代码: | 德国;DE |
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摘要: | 一种在硅衬底中的通孔中电沉积高纯度铜以形成穿硅通孔(TSV)的工艺,包括:将所述硅衬底浸入电解铜镀层系统中的电解池中,其中所述电解池包括酸、铜离子源、亚铁和/或正铁离子源以及用于控制所沉积的铜的物理机械特性的至少一种添加剂;以及施加电压的时间足以电沉积高纯度铜来形成TSV,其中在所述池中建立Fe+2/Fe+3氧化还原系统,以通过从铜金属源溶解铜离子来提供将要被电沉积的额外的铜离子。 | ||
搜索关键词: | 用于 沉积 工艺 穿硅通孔 tsv 中的 芯片 晶片 互连 | ||
【主权项】:
一种在硅衬底中的通孔中电沉积高纯度铜以形成穿硅通孔(TSV)的工艺,包括:提供包括至少一个通孔的硅衬底,其中所述通孔包括内表面,该内表面具有范围从约1.5微米到约30微米的内部宽度尺寸、从约5微米到约450微米的深度以及至少为3∶1的深度∶宽度的深宽比;可选择地,在所述通孔的内表面上形成介电层;在所述通孔的内表面上方或当存在所述介电层时在所述介电层的上方形成阻挡层,其中所述阻挡层防止铜扩散到所述硅衬底中;在所述阻挡层上方形成具有足够厚度的基础金属层,并覆盖所述通孔的内表面,以获得用于随后的铜的电解沉积的足够的导电率;将所述硅衬底浸入电解镀铜系统中的电解池中,该系统连接有作为阴极的所述基础金属层,该系统还包括不能溶解的且尺寸不变的阳极以及铜金属源,其中所述电解池包括酸、铜离子源、亚铁离子和/或正铁离子源,以及用于控制所沉积的铜的物理机械特性的至少一种添加剂;以及在所述不能溶解的且尺寸不变的阳极与所述基础金属层之间施加电压,使得电流在其间流动的时间足以电沉积高纯度铜来形成TSV,其中在所述池中建立Fe+2/Fe+3氧化还原系统,以通过从所述铜金属源溶解铜离子来提供将要被电沉积的额外的铜离子。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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