[发明专利]应用于整数分频锁相环路中的鉴频鉴相器和电荷泵电路无效
| 申请号： | 201010148260.5 | 申请日： | 2010-04-15 |
| 公开（公告）号： | CN101807915A | 公开（公告）日： | 2010-08-18 |
| 发明（设计）人： | 任俊彦;蔡德鋆;傅海鹏;陈丹凤;李巍;李宁;许俊;叶凡 | 申请（专利权）人： | 复旦大学 |
| 主分类号： | H03L7/08 | 分类号： | H03L7/08 |
| 代理公司： | 上海正旦专利代理有限公司 31200 | 代理人： | 陆飞;盛志范 |
| 地址： | 20043*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明属于集成电路技术领域，具体涉及一种应用于整数分频锁相环路中的PFD(鉴频鉴相器)和CP(电荷泵)电路。其中，PFD电路采用4个Latch，使得输出信号UP和UPB、DN和DNB具有很好的对称性，以减小对CP电路的时钟馈通效应和电荷注入效应；另外采用2个小尺寸的PMOS管，以实现了电平恢复功能，解决UP、UPB、DN、DNB四路信号在电路刚上电时的不确定状态，避免CP的工作错误。CP电路中采用2个轨到轨的恒定跨导运放，以解决电流失配、电荷分享的问题；采用4个dummy管，以解决电荷注入的问题；采用2个小尺寸电阻，以有效地降低充放电电流尖峰。 | ||
| 搜索关键词： | 应用于 整数 分频 环路 中的 鉴频鉴相器 电荷 电路 | ||
【主权项】：
一种应用于整数分频锁相环路中的PFD及CP电路，其特征在于：PFD电路采用4个Latch，使得输出信号UP和UPB、DN和DNB具有很好的对称性，以减小对CP电路的时钟馈通效应和电荷注入效应；另外采用2个小尺寸的PMOS管，以实现了电平恢复功能，解决UP、UPB、DN、DNB四路信号在电路刚上电时的不确定状态，避免CP的工作错误；CP电路中采用2个轨到轨的恒定跨导运放，以解决电流失配、电荷分享的问题；采用4个dummy管，以解决电荷注入的问题；采用2个小尺寸电阻，以有效地降低充放电电流尖峰；PFD电路输出的4路脉冲电压信号UP、UPB、DN、DNB分别送给CP的4路输入信号端UP、UPB、DN、DNB，最后在CP输出端Vctr得到LPF的电流控制信号，将这一电流控制信号转换为VCO的电压控制信号，用于控制VCO的振荡频率；其中PFD的输入信号REF是由晶振提供的48MHz参考信号，DIV信号来自经过VCO和Divider电路之后输出的反馈信号。
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