[发明专利]半导体集成电路器件的制造方法无效
申请号: | 201010155938.2 | 申请日: | 2010-04-08 |
公开(公告)号: | CN101866862A | 公开(公告)日: | 2010-10-20 |
发明(设计)人: | 牧浩;伊势诚 | 申请(专利权)人: | 瑞萨电子株式会社 |
主分类号: | H01L21/50 | 分类号: | H01L21/50;H01L21/56;H01L21/60 |
代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 王茂华;陈宇萱 |
地址: | 日本神*** | 国省代码: | 日本;JP |
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摘要: | 本发明涉及一种半导体集成电路器件的制造方法。尽管在管芯键合中在半导体芯片的背表面上提供有粘附剂层,但是层叠处理(主压力键合)需要在管芯键合过程(临时压力键合)之后确保粘附剂层的粘附状态。在这种情况下,通常是通过在加热的同时利用增压部件从上到下按压芯片的背面来进行粘附剂的硬化。显然,由于芯片变得较薄,在通过这种机械增压方法来层叠芯片的层叠处理中,存在各种问题。也即,问题包括悬垂状态下芯片的部分损坏、由弯曲和不均匀增压导致的芯片位置偏移等。本发明是在衬底产品的管芯键合过程中,在对电路衬底上的多个半导体芯片进行层叠和临时压力键合之后,通过静态气压来执行层叠处理。 | ||
搜索关键词: | 半导体 集成电路 器件 制造 方法 | ||
【主权项】:
一种半导体集成电路器件的制造方法,包括步骤:(a)将在其第一主表面上具有多个器件区域的电路衬底引入管芯键合设备;(b)在所述管芯键合设备中,将多个芯片层叠体固定在每个所述器件区域中,每个所述芯片层叠体具有在其上层中的半导体芯片以及其后侧上的粘附剂层,从而将所述芯片层叠体层叠在彼此偏移的相应位置中;以及(c)在步骤(b)之后,在所述管芯键合设备中,在将每个所述芯片层叠体加热到第一温度的状态下,在每个所述芯片层叠体的暴露表面上施加均匀的静态气压。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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