[发明专利]数字逻辑电路及制造方法无效
| 申请号： | 201010205890.1 | 申请日： | 2010-06-13 |
| 公开（公告）号： | CN102281055A | 公开（公告）日： | 2011-12-14 |
| 发明（设计）人： | 杨景荣;游宗儒 | 申请（专利权）人： | 瑞鼎科技股份有限公司 |
| 主分类号： | H03K19/20 | 分类号： | H03K19/20 |
| 代理公司： | 中国商标专利事务所有限公司 11234 | 代理人： | 万学堂;周伟明 |
| 地址： | 中国台湾新竹市*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 本发明是关于一种数字逻辑电路及制造方法，包含电压轨、接地轨及复数逻辑电路轨，其中每一逻辑电路轨是分别电连接于电压轨及接地轨。逻辑电路轨包含相互并排并电连接于电压轨及接地轨的逻辑单元及辅助单元。逻辑单元包含分别电连接于电压轨及接地轨的逻辑电压端及逻辑接地端。辅助单元亦包含分别电连接于电压轨及接地轨的辅助电压端及辅助接地端。辅助电压端与逻辑电压端间的宽度比值和辅助接地端与逻辑接地端间的宽度比值至少其中之一大于1。 | ||
| 搜索关键词： | 数字 逻辑电路 制造 方法 | ||
【主权项】：
一种数字逻辑电路，包含：一电压轨；一接地轨；复数逻辑电路轨，其中每一该逻辑电路轨分别电连接于该电压轨及该接地轨，该逻辑电路轨包含：至少一逻辑单元，其中该逻辑单元包含一逻辑电压端及一逻辑接地端，分别电连接于该电压轨及该接地轨；以及至少一辅助单元，其中该辅助单元包含一辅助电压端及一辅助接地端，分别电连接于该电压轨及该接地轨；其中该逻辑单元及该辅助单元为并排，该辅助电压端与该逻辑电压端间的一第一宽度比值及该辅助接地端与该电阻接地端间的一第二宽度至少其中之一比值大于1。
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