[发明专利]N型射频LDMOS中多晶硅P型沉阱的制造方法有效
申请号: | 201010265249.7 | 申请日: | 2010-08-26 |
公开(公告)号: | CN102376618A | 公开(公告)日: | 2012-03-14 |
发明(设计)人: | 钱文生;韩峰 | 申请(专利权)人: | 上海华虹NEC电子有限公司 |
主分类号: | H01L21/74 | 分类号: | H01L21/74;H01L21/316 |
代理公司: | 上海浦一知识产权代理有限公司 31211 | 代理人: | 丁纪铁 |
地址: | 201206 上*** | 国省代码: | 上海;31 |
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摘要: | 本发明公开了一种N型射频LDMOS中多晶硅P型沉阱的制造方法,包括步骤:在P型硅衬底上形成P型外延层并刻蚀出V型槽;在V型槽侧壁上形成第一氧化层;在硅衬底上淀积第一层多晶硅并进行P型杂质的离子注入;在第一层多晶硅上淀积第二层多晶硅并将V型槽完全填满;进行研磨使多晶硅表面平整化;在硅衬底上形成第二氧化层作为沉阱区域外的保护层;进行退火推进,将P型杂质推进整个V型槽的多晶硅中并形成多晶硅P型沉阱;形成N型射频LDMOS的P阱、漂移区、源极、栅极、漏极。本发明方法能提高器件的击穿电压、缩小版图面积、提高器件密度、工艺参数可调性强、适用范围广。 | ||
搜索关键词: | 射频 ldmos 多晶 型沉阱 制造 方法 | ||
【主权项】:
一种N型射频LDMOS中多晶硅P型沉阱的制造方法,其特征在于,包括如下步骤:步骤一、在一P型硅衬底上形成P型外延层,在所述P型外延层上的沉阱区域刻蚀出V型槽;步骤二、在所述V型槽侧壁上形成第一氧化层,形成方法为:在所述P型硅衬底上形成所述第一氧化层,去除所述V型槽底部表面以及所述V型槽外部的所述P型外延层表面的所述第一氧化层,只保留所述V型侧壁上的所述第一氧化层;步骤三、在所述P型硅衬底上淀积第一层多晶硅,并对所述第一层多晶硅进行P型杂质的离子注入,所述第一层多晶硅的厚度满足不填满所述V型槽的条件;步骤四、在所述第一层多晶硅上淀积第二层多晶硅,淀积后所述第一层多晶硅和所述第二层多晶硅总厚度满足将所述V型槽完全填满的条件;步骤五、对所述P型硅衬底进行研磨,去除所述V型槽外部的所述P型外延层上的所述第一层多晶硅和所述第二层多晶硅并使所述V型槽上部的所述第一层多晶硅和所述第二层多晶硅表面平整化;步骤六、在所述P型硅衬底上形成第二氧化层,所述第二氧化层作为所述沉阱区域外的保护层;步骤七、对所述P型硅衬底进行退火推进,将所述第一层多晶硅中离子注入的P型杂质推进整个所述V型槽中的所述第一层多晶硅和第二层多晶硅中,形成多晶硅P型沉阱;步骤八、形成所述N型射频LDMOS的P阱、漂移区、源极、栅极、漏极。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
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