[发明专利]具有锁相回路的数字频率合成器无效
| 申请号： | 201010514674.5 | 申请日： | 2010-10-21 |
| 公开（公告）号： | CN102457274A | 公开（公告）日： | 2012-05-16 |
| 发明（设计）人： | 吕龙腾;黄瑞荣 | 申请（专利权）人： | 钰宝科技股份有限公司 |
| 主分类号： | H03L7/18 | 分类号： | H03L7/18 |
| 代理公司： | 北京康信知识产权代理有限责任公司 11240 | 代理人： | 余刚;吴孟秋 |
| 地址： | 中国台*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 一种具有锁相回路的数字频率合成器，其具有一时钟追踪单元、一与该时钟追踪单元连接的第一锁相电路、一与该时钟追踪单元及该第一锁相电路连接的数字除频单元，及一设置于该数字除频单元后并与之连接的第二锁相电路。该数字除频单元控制一单位时钟组中的时钟数目，该时钟追踪单元追踪入射信号的时钟，以增减该数字除频器中的时钟数目，达到时钟加速或时钟减速的作用。而该第一锁相电路及该第二锁相电路配合该数字除频单元进行时钟频率的乘除，且该第二锁相电路更用以吸收经过该数字除频单元增减时钟后的时钟扰动。 | ||
| 搜索关键词： | 具有 回路 数字 频率 合成器 | ||
【主权项】：
一种具有锁相回路的数字频率合成器，其特征在于，包括：一第一锁相电路(10)，其接收一入射信号(1)；一控制多个单位时钟组(50a、50b、50c)中的时钟数目的数字除频单元(20)，所述数字除频单元(20)的输入端与所述第一锁相电路(10)连接；及与所述第一锁相电路(10)相对设置的一第二锁相电路(30)，所述第二锁相电路(30)与所述数字除频单元(20)的输出端连接，所述第一锁相电路(10)及所述第二锁相电路(30)配合所述数字除频单元(20)进行频率的乘除。
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