[发明专利]一种多Ready输入中央处理器的实现方法有效
| 申请号： | 201010517076.3 | 申请日： | 2010-10-22 |
| 公开（公告）号： | CN101989191A | 公开（公告）日： | 2011-03-23 |
| 发明（设计）人： | 余国强;龚龙庆;段青亚;宋阳 | 申请（专利权）人： | 中国航天科技集团公司第九研究院第七七一研究所 |
| 主分类号： | G06F9/30 | 分类号： | G06F9/30 |
| 代理公司： | 西安通大专利代理有限责任公司 61200 | 代理人： | 汪人和 |
| 地址： | 710054 *** | 国省代码： | 陕西;61 |
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| 摘要： | 本发明提供了一种多Ready输入中央处理器的实现方法，其将就绪(Ready)处理逻辑嵌入到处理器(CPU)中，同时提供多个就绪(Ready)输入接口，取消了外部就绪(Ready)组合逻辑，强化了CPU功能，缩短了外设与CPU的交互时间，简化了外围设计电路。 | ||
| 搜索关键词： | 一种 ready 输入 中央处理器 实现 方法 | ||
【主权项】：
一种多Ready输入中央处理器的实现方法，其特征在于：包括以下步骤：步骤1)：规划处理器需要引入外部就绪Ready的信号数量；步骤2)：设定就绪(Ready)低输入有效；步骤3)：将每个处于就绪状态的信号与各自对应的片选信号相或后再相与形成一个统一的处理内部就绪信号，最后通过处理器时钟进行同步处理后供处理器内部等待逻辑使用；步骤4)设定处理器控制信号与外部就绪信号的时序关系；步骤5)处理器接收到步骤3)形成的就绪信号后，判断是采用步骤3)形成的就绪信号还是采用处理器本身的就绪信号，接着，该被选定的就需信号在处理器内部通过带有Ready信号的CPU io读写访问状态机进行读写处理。
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