[发明专利]用于数模转换器(DAC)的积分非线性(INL)和微分非线性(DNL)校正技术有效
| 申请号： | 201010554075.6 | 申请日： | 2010-11-11 |
| 公开（公告）号： | CN102064829A | 公开（公告）日： | 2011-05-18 |
| 发明（设计）人： | I·阿希 | 申请（专利权）人： | 英特赛尔美国股份有限公司 |
| 主分类号： | H03M1/10 | 分类号： | H03M1/10 |
| 代理公司： | 上海专利商标事务所有限公司 31100 | 代理人： | 李玲 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 对于适于接受N位数字输入码的DAC的多个子分段确定INL值，并且确定和存储可以用来减小INL值的范围(从而提高DAC的线性)的第一组校正码。此外，对确定了INL值的多个子分段确定DNL值，并且确定和存储可以用于保证所有的DNL值＞-1的(从而保证DAC是单调的)第二组校正码。这可以包括使用分辨率的一个或多个附加位使(DAC可以接受的)2^N个可能的数字输入码中的至少某一些重新映射成2^N个以上的可能数字输出码，以确保所有的DNL值＞-1。此后当执行数模转换时使用如此存储的第一和第二组。 | ||
| 搜索关键词： | 用于 数模转换器 dac 积分 非线性 inl 微分 dnl 校正 技术 | ||
【主权项】：
一种与数模转换器(DAC)一起使用的方法，所述方法包括：(a)确定适用于接受N位数字输入码的DAC的多个子分段的积分非线性(INL)值；(b)确定可用于减小到一范围的INL值从而提高DAC的线性的第一组校正码；(c)将第一组校正码存储在与DAC相关联的非易失性存储器中，以使第一组校正码可在数码转换期间访问；(d)对在步骤(a)确定了INL值的多个子分段，确定微分非线性(DNL)值；(e)确定可用来确保所有的DNL值＞‑1从而确保DAC单调的第二组校正码；以及(f)将第二组校正码存储在与DAC相关联的非易失性存储器中，以使第二组校正码可在数码转换期间访问。
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