[实用新型]利用低倍率取样时钟实现数字时钟恢复的电路无效
| 申请号： | 201020568008.5 | 申请日： | 2010-10-20 |
| 公开（公告）号： | CN201839296U | 公开（公告）日： | 2011-05-18 |
| 发明（设计）人： | 苏红;谢建庭;常涛;王克;宋光伟;李柬;孙光;苗尧飞;李艳军;李续 | 申请（专利权）人： | 天津光电通信技术有限公司 |
| 主分类号： | H04L7/00 | 分类号： | H04L7/00 |
| 代理公司： | 天津中环专利商标代理有限公司 12105 | 代理人： | 胡京生 |
| 地址： | 300211*** | 国省代码： | 天津;12 |
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| 摘要： | 本实用新型涉及一种利用低倍率取样时钟实现数字时钟恢复的电路，它包括FPGA芯片，FPGA芯片内部电路的连接关系为：DLL级联倍频电路的输出，一路与分频器连接，另一路进入边沿检测电路供其使用，检测结果对分频器复位。本实用新型的特点是：利用XILINXFPGA内DLL的倍频功能，生成一个速率为接收数据速率4倍的取样时钟，利用它从接收的异步数据中恢复数据时钟的方法，本设计方法与一般的数字时钟恢复方法相比较，要求较低速率的取样时钟，降低了设计难度。 | ||
| 搜索关键词： | 利用 倍率 取样 时钟 实现 数字 恢复 电路 | ||
【主权项】：
一种利用低倍率取样时钟实现数字时钟恢复的电路，其特征在于：包括FPGA芯片，所述FPGA芯片内部电路的连接关系为：DLL级联倍频电路的输出，一路与分频器连接，另一路进入边沿检测电路供其使用，检测结果对分频器复位。
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